針對現(xiàn)場可編程門陣列 (FPGA)的Libero IDE 8.4(Actel)
發(fā)布時間:2008/9/17 0:00:00 訪問次數(shù):626
actel公司宣布其libero®集成開發(fā)環(huán)境(ide)增添全新的功耗優(yōu)化和增強的設(shè)計創(chuàng)建功能。全新的liberoide8.4針對基于flash的igloo®、iglooplus和proasic®3l現(xiàn)場可編程門陣列(fpga),提供由1.14v至1.575v的fpga內(nèi)核工作電壓范圍,為設(shè)計人員提供額外的內(nèi)核電壓選擇,以實現(xiàn)更低的功耗。新版本liberoide改進了smartpower功耗分析工具,便于比較同一設(shè)計的多種設(shè)計實現(xiàn)和器件不同工作條件下的狀況,以及它們所帶來的功耗和電池壽命影響。liberoide8.4允許由actel創(chuàng)建或第三方的ip構(gòu)件、用戶開發(fā)的hdl模塊,以及膠粘邏輯功能在設(shè)計項目中輕易集成,從而實現(xiàn)快速、高效的設(shè)計創(chuàng)建。
actel軟件工具高級市場經(jīng)理fredwickersham稱:“我們明白在功耗和開發(fā)周期敏感的市場中,軟件開發(fā)工具對于項目的成功至關(guān)重要。不管是簡單的低功耗設(shè)計或復雜的以處理器為基礎(chǔ)的系統(tǒng)級芯片方案,全新liberoide8.4都可以顯著地簡化設(shè)計過程,通過提供易于使用的工具以找出設(shè)計中的功耗源并降低其功耗,省去繁瑣的設(shè)計任務如針對邏輯功能編寫新的hdl代碼,自動實現(xiàn)多種功能在fpga上或外部的連接!
liberoide8.4的提升功能
全新liberoide8.4擴大了fpga的內(nèi)核工作電壓范圍,達到1.14v至1.575v,適合基于flash的1.2vigloo、iglooplus和proasic3lfpga應用,使設(shè)計人員擁有更多的內(nèi)核工作電壓選擇,以達更低的功耗。liberoide8.4還提升了smartpower功耗分析功能。在新版本liberoide中,用戶可以創(chuàng)建和比較多種用戶定義的功率曲線“場景”(scenarios),讓用戶測試不同的運作狀況,更好地針對其功率敏感應用找出最佳的設(shè)計方法。smartpower同時新增圖形化的功耗顯示功能,為用戶帶來更好的易用性,以及全面了解設(shè)計中所有功能模式的功耗狀況。
傳統(tǒng)的設(shè)計方法包括從底層生成hdl代碼或原理圖設(shè)計,以便創(chuàng)建和縫合,構(gòu)成fpga系統(tǒng)或子系統(tǒng)必需的邏輯功能組合。liberoide8.4改進了smartdesign功能,允許用戶將由自己或第三方創(chuàng)建的hdl模塊、ip核,以及膠粘邏輯功能導入項目區(qū),因而能夠從導入功能或現(xiàn)有的ip核目錄中快速選擇所需的構(gòu)件,然后將它們拖放到構(gòu)件視圖中的一個白板“畫布”(canvas)上,讓用戶在其中查看和連接這些構(gòu)件。最后自動創(chuàng)建出經(jīng)設(shè)計準則檢查和可預備進行物理綜合(synthesis-ready)的hdl文件。smartdesign支持快速構(gòu)建簡單的設(shè)計或精細復雜的基于處理器的系統(tǒng)級芯片解決方案。
價格與供貨
actelliberoidegold(金)版本可供用戶免費在windows平臺上使用,actelliberoide8.4platinum(白金)版本則運行于windows和linux平臺,而所有版本均提供一年期可更新的使用。
歡迎轉(zhuǎn)載,信息來自維庫電子市場網(wǎng)(www.dzsc.com)
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liberoide8.4的提升功能
全新liberoide8.4擴大了fpga的內(nèi)核工作電壓范圍,達到1.14v至1.575v,適合基于flash的1.2vigloo、iglooplus和proasic3lfpga應用,使設(shè)計人員擁有更多的內(nèi)核工作電壓選擇,以達更低的功耗。liberoide8.4還提升了smartpower功耗分析功能。在新版本liberoide中,用戶可以創(chuàng)建和比較多種用戶定義的功率曲線“場景”(scenarios),讓用戶測試不同的運作狀況,更好地針對其功率敏感應用找出最佳的設(shè)計方法。smartpower同時新增圖形化的功耗顯示功能,為用戶帶來更好的易用性,以及全面了解設(shè)計中所有功能模式的功耗狀況。
傳統(tǒng)的設(shè)計方法包括從底層生成hdl代碼或原理圖設(shè)計,以便創(chuàng)建和縫合,構(gòu)成fpga系統(tǒng)或子系統(tǒng)必需的邏輯功能組合。liberoide8.4改進了smartdesign功能,允許用戶將由自己或第三方創(chuàng)建的hdl模塊、ip核,以及膠粘邏輯功能導入項目區(qū),因而能夠從導入功能或現(xiàn)有的ip核目錄中快速選擇所需的構(gòu)件,然后將它們拖放到構(gòu)件視圖中的一個白板“畫布”(canvas)上,讓用戶在其中查看和連接這些構(gòu)件。最后自動創(chuàng)建出經(jīng)設(shè)計準則檢查和可預備進行物理綜合(synthesis-ready)的hdl文件。smartdesign支持快速構(gòu)建簡單的設(shè)計或精細復雜的基于處理器的系統(tǒng)級芯片解決方案。
價格與供貨
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傳統(tǒng)的設(shè)計方法包括從底層生成hdl代碼或原理圖設(shè)計,以便創(chuàng)建和縫合,構(gòu)成fpga系統(tǒng)或子系統(tǒng)必需的邏輯功能組合。liberoide8.4改進了smartdesign功能,允許用戶將由自己或第三方創(chuàng)建的hdl模塊、ip核,以及膠粘邏輯功能導入項目區(qū),因而能夠從導入功能或現(xiàn)有的ip核目錄中快速選擇所需的構(gòu)件,然后將它們拖放到構(gòu)件視圖中的一個白板“畫布”(canvas)上,讓用戶在其中查看和連接這些構(gòu)件。最后自動創(chuàng)建出經(jīng)設(shè)計準則檢查和可預備進行物理綜合(synthesis-ready)的hdl文件。smartdesign支持快速構(gòu)建簡單的設(shè)計或精細復雜的基于處理器的系統(tǒng)級芯片解決方案。
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