測(cè)頻與測(cè)周期控制部件設(shè)計(jì)
發(fā)布時(shí)間:2008/10/13 0:00:00 訪問(wèn)次數(shù):392
如圖1 所示,當(dāng)d觸發(fā)器的輸入端start為高電平時(shí),若fin端來(lái)一個(gè)上升沿,則q端變?yōu)楦唠娖,?dǎo)通fin→clk1和fsd→clk2,同時(shí)eend被置為高電平作為標(biāo)志;當(dāng)d觸發(fā)器的輸入端start為低電平時(shí),若fin端輸入一個(gè)脈沖上沿,則fin→clk1與fsd→clk2的信號(hào)通道被切斷。
圖1 測(cè)頻與測(cè)hi期控制部分電路
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如圖1 所示,當(dāng)d觸發(fā)器的輸入端start為高電平時(shí),若fin端來(lái)一個(gè)上升沿,則q端變?yōu)楦唠娖,?dǎo)通fin→clk1和fsd→clk2,同時(shí)eend被置為高電平作為標(biāo)志;當(dāng)d觸發(fā)器的輸入端start為低電平時(shí),若fin端輸入一個(gè)脈沖上沿,則fin→clk1與fsd→clk2的信號(hào)通道被切斷。
圖1 測(cè)頻與測(cè)hi期控制部分電路
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