改變74LS163二進(jìn)制計(jì)數(shù)器為十進(jìn)制計(jì)數(shù)器
發(fā)布時(shí)間:2016/12/15 21:30:11 訪問(wèn)次數(shù):8415
改變74LS163二進(jìn)制計(jì)數(shù)器為十進(jìn)制計(jì)數(shù)器
連接電路圖如圖22.2所示,即用一FDS4435BZ個(gè)與非門(mén),其兩個(gè)輸人取自QA和QD,輸出接清零端α'R。當(dāng)?shù)?個(gè)脈沖結(jié)束時(shí),鈑和QD都為“1”,則與非門(mén)輸出為低電平“O”,并加到αR端,因CIR為同步清零端,此時(shí)雖已建立清零信號(hào),但并不執(zhí)行清零,只有第1O個(gè)時(shí)鐘脈沖到來(lái)后74LS163才被清零,這就是同步清零的意義所在。
驗(yàn)證圖22.2是否如同一個(gè)模10計(jì)數(shù)器:
圖22.2 用74I'⒏63構(gòu)成十進(jìn)制計(jì)數(shù)器
用兩個(gè)74I'S163連接成一個(gè)兩位十進(jìn)制計(jì)數(shù)器。連接電路圖如圖22.3所示。
當(dāng)74LS163(1)記到9時(shí)(1001),產(chǎn)生清零信號(hào)并同時(shí)使74LS163(2)的控制端ENT為高電平,即使忽s163(2)開(kāi)始計(jì)數(shù),同樣記到9時(shí)(1001)產(chǎn)生低電平清零信號(hào)使其清零,輸出顯示為0,并同時(shí)產(chǎn)生一進(jìn)位信號(hào)(【D為高電平),可將此信號(hào)加到一發(fā)光二極管顯示其進(jìn)位輸出。計(jì)數(shù)器的4位輸出可連接到實(shí)驗(yàn)箱上的譯碼顯示器的4個(gè)輸人端,電路如圖22.3所示(注意,計(jì)數(shù)器的QA~QD和譯碼器的輸人端A~B一一對(duì)應(yīng)連接)。
改變74LS163二進(jìn)制計(jì)數(shù)器為十進(jìn)制計(jì)數(shù)器
連接電路圖如圖22.2所示,即用一FDS4435BZ個(gè)與非門(mén),其兩個(gè)輸人取自QA和QD,輸出接清零端α'R。當(dāng)?shù)?個(gè)脈沖結(jié)束時(shí),鈑和QD都為“1”,則與非門(mén)輸出為低電平“O”,并加到αR端,因CIR為同步清零端,此時(shí)雖已建立清零信號(hào),但并不執(zhí)行清零,只有第1O個(gè)時(shí)鐘脈沖到來(lái)后74LS163才被清零,這就是同步清零的意義所在。
驗(yàn)證圖22.2是否如同一個(gè)模10計(jì)數(shù)器:
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用兩個(gè)74I'S163連接成一個(gè)兩位十進(jìn)制計(jì)數(shù)器。連接電路圖如圖22.3所示。
當(dāng)74LS163(1)記到9時(shí)(1001),產(chǎn)生清零信號(hào)并同時(shí)使74LS163(2)的控制端ENT為高電平,即使忽s163(2)開(kāi)始計(jì)數(shù),同樣記到9時(shí)(1001)產(chǎn)生低電平清零信號(hào)使其清零,輸出顯示為0,并同時(shí)產(chǎn)生一進(jìn)位信號(hào)(【D為高電平),可將此信號(hào)加到一發(fā)光二極管顯示其進(jìn)位輸出。計(jì)數(shù)器的4位輸出可連接到實(shí)驗(yàn)箱上的譯碼顯示器的4個(gè)輸人端,電路如圖22.3所示(注意,計(jì)數(shù)器的QA~QD和譯碼器的輸人端A~B一一對(duì)應(yīng)連接)。
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