AMD核邏輯芯片組SiS748核電壓和I/O電壓
發(fā)布時(shí)間:2021/1/21 12:51:15 訪問次數(shù):1143
AMD核邏輯芯片組SiS748，用于AMD K7平臺(tái)，它是業(yè)界第一個(gè)在市場上支持400MHz前邊總線的AMD 芯片組。
靈活的時(shí)鐘網(wǎng)絡(luò)能驅(qū)動(dòng)用戶編程的PLL，這些PLL能被編程成頻率的倍數(shù)和分?jǐn)?shù)，以改善I/O性能。Eclipse-II FPGA不僅降低了高性能系統(tǒng)的片到片的時(shí)延，還降低了板上的元件數(shù)目，從而進(jìn)一步降低了終端系統(tǒng)的成本。
Eclipse-II FPGA系列產(chǎn)品有廣泛的用途如移動(dòng)設(shè)備，無線，手持，手提和醫(yī)療設(shè)備。
制造商:Monolithic Power Systems (MPS)產(chǎn)品種類:開關(guān)控制器RoHS: 拓?fù)浣Y(jié)構(gòu):Flyback輸出端數(shù)量:1 Output開關(guān)頻率:400 kHz輸入電壓:4.2 V to 35 V安裝風(fēng)格:SMD/SMT封裝 / 箱體:TSOT-23-6封裝:Cut Tape封裝:MouseReel封裝:Reel描述/功能:Low-drop diode emulator IC輸出功率:150 W輸出類型:Rail to rail產(chǎn)品:Fast Recovery Rectifiers系列:商標(biāo):Monolithic Power Systems (MPS)關(guān)閉:Shutdown工作電源電流:8 mA工作電源電壓:4.2 V to 35 V產(chǎn)品類型:Switching Controllers3000子類別:PMIC - Power Management ICs單位重量:6.300 mg
當(dāng)處理器的核電壓和I/O電壓在電源起動(dòng)時(shí)在一定的電壓差內(nèi)需要互相跟蹤時(shí)，TPS54x73能可靠地加電。在起動(dòng)時(shí)核電壓等于I/O電壓減去二極管壓降。
該高集成度的芯片，和采用獨(dú)立的接收器/發(fā)送器相比，大大地減少了元件數(shù)和PCB的空間。它采用零差結(jié)構(gòu)，極大地簡化了頻率編制，消除了IF級(jí)和由此需要的SAW濾波器。它是40引腳P-VQFN封裝，間距0.5mm。
(素材來源：eccn和ttic.如涉版權(quán)請(qǐng)聯(lián)系刪除。特別感謝）
AMD核邏輯芯片組SiS748，用于AMD K7平臺(tái)，它是業(yè)界第一個(gè)在市場上支持400MHz前邊總線的AMD 芯片組。
靈活的時(shí)鐘網(wǎng)絡(luò)能驅(qū)動(dòng)用戶編程的PLL，這些PLL能被編程成頻率的倍數(shù)和分?jǐn)?shù)，以改善I/O性能。Eclipse-II FPGA不僅降低了高性能系統(tǒng)的片到片的時(shí)延，還降低了板上的元件數(shù)目，從而進(jìn)一步降低了終端系統(tǒng)的成本。
Eclipse-II FPGA系列產(chǎn)品有廣泛的用途如移動(dòng)設(shè)備，無線，手持，手提和醫(yī)療設(shè)備。
制造商:Monolithic Power Systems (MPS)產(chǎn)品種類:開關(guān)控制器RoHS: 拓?fù)浣Y(jié)構(gòu):Flyback輸出端數(shù)量:1 Output開關(guān)頻率:400 kHz輸入電壓:4.2 V to 35 V安裝風(fēng)格:SMD/SMT封裝 / 箱體:TSOT-23-6封裝:Cut Tape封裝:MouseReel封裝:Reel描述/功能:Low-drop diode emulator IC輸出功率:150 W輸出類型:Rail to rail產(chǎn)品:Fast Recovery Rectifiers系列:商標(biāo):Monolithic Power Systems (MPS)關(guān)閉:Shutdown工作電源電流:8 mA工作電源電壓:4.2 V to 35 V產(chǎn)品類型:Switching Controllers3000子類別:PMIC - Power Management ICs單位重量:6.300 mg
當(dāng)處理器的核電壓和I/O電壓在電源起動(dòng)時(shí)在一定的電壓差內(nèi)需要互相跟蹤時(shí)，TPS54x73能可靠地加電。在起動(dòng)時(shí)核電壓等于I/O電壓減去二極管壓降。
該高集成度的芯片，和采用獨(dú)立的接收器/發(fā)送器相比，大大地減少了元件數(shù)和PCB的空間。它采用零差結(jié)構(gòu)，極大地簡化了頻率編制，消除了IF級(jí)和由此需要的SAW濾波器。它是40引腳P-VQFN封裝，間距0.5mm。
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