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處理器對(duì)從外面讀入數(shù)據(jù)或是向外面輸出數(shù)據(jù)的一個(gè)接口

發(fā)布時(shí)間:2023/7/30 12:00:12 訪問(wèn)次數(shù):65

高精度制導(dǎo)系統(tǒng),利用各種傳感器獲取待攻擊目標(biāo)的位置和速度等信息,通過(guò)對(duì)信息分析和處理后實(shí)時(shí)修正、控制導(dǎo)彈的飛行軌跡,完成對(duì)目標(biāo)的有效攻擊。

彈載計(jì)算機(jī)具有體積小、成本低、速度快、層疊結(jié)構(gòu)等顯著特點(diǎn),并且單個(gè)模塊融合多種接口。

信號(hào)處理器TMS320C6202B,最大工作頻率250MHz,片上集成了3Mbit的數(shù)據(jù)/程序存儲(chǔ)器SRAM、兩路32位的定時(shí)器、EMIF總線接口、4路相互獨(dú)立的DMA通道、3路MCBSP串行接口,內(nèi)核采用1.5V供電,外圍采用3.3V供電,封裝為352芯BGA。

以ARM cortexA9 CPU做仿真實(shí)驗(yàn),在CPU訪存接口上掛一個(gè)理想的32位DDR模型(有訪問(wèn)請(qǐng)求立即響應(yīng),沒(méi)有延時(shí)),CPU頻率為1008MHz時(shí),測(cè)得數(shù)據(jù)拷貝帶寬為2140 MB/s。

一般會(huì)配置540MHz 32位DDR,能提供的理論帶寬為4320MB/s,已經(jīng)遠(yuǎn)超cortex-A9的帶寬吞吐能力了,這種情況下帶寬性能測(cè)試得到的只是CPU的訪存性能,而不是DDR的總體帶寬性能。 現(xiàn)在的帶寬吞吐性能評(píng)測(cè)軟件都是利用統(tǒng)計(jì)CPU訪問(wèn)DDR的速度來(lái)評(píng)估芯片總的帶寬吞吐性能,這就需要考慮CPU Cache的影響。

I/O端口存在讀、寫(xiě)性問(wèn)題,有的端口是只讀的,有的端口是只寫(xiě)的,還有的端口是即可讀也可寫(xiě),其讀寫(xiě)性是由外設(shè)芯片的寄存器所決定的,在芯片的數(shù)據(jù)手冊(cè)中能找到。

存儲(chǔ)器外設(shè)也存在I/O端口,以對(duì)其進(jìn)行一定的控制。從I/O端口這一名字來(lái)看,對(duì)于處理器來(lái)說(shuō),就是對(duì)從外面讀入數(shù)據(jù)或是向外面輸出數(shù)據(jù)的一個(gè)接口總稱(chēng)。

與存儲(chǔ)器外設(shè)所不同的是,I/O外設(shè)所點(diǎn)用的地址一般都很少。比如一個(gè)I/O外設(shè)可能存在多個(gè)控制寄存器,這些控制寄存器從處理器來(lái)看就是多個(gè)I/O端口(地址),向這個(gè)地址寫(xiě)數(shù)據(jù)就是向外設(shè)所對(duì)應(yīng)的寄存器寫(xiě)數(shù)據(jù),反之,也可以是讀。


深圳市慈安科技有限公司http://cakj.51dzw.com

高精度制導(dǎo)系統(tǒng),利用各種傳感器獲取待攻擊目標(biāo)的位置和速度等信息,通過(guò)對(duì)信息分析和處理后實(shí)時(shí)修正、控制導(dǎo)彈的飛行軌跡,完成對(duì)目標(biāo)的有效攻擊。

彈載計(jì)算機(jī)具有體積小、成本低、速度快、層疊結(jié)構(gòu)等顯著特點(diǎn),并且單個(gè)模塊融合多種接口。

信號(hào)處理器TMS320C6202B,最大工作頻率250MHz,片上集成了3Mbit的數(shù)據(jù)/程序存儲(chǔ)器SRAM、兩路32位的定時(shí)器、EMIF總線接口、4路相互獨(dú)立的DMA通道、3路MCBSP串行接口,內(nèi)核采用1.5V供電,外圍采用3.3V供電,封裝為352芯BGA。

以ARM cortexA9 CPU做仿真實(shí)驗(yàn),在CPU訪存接口上掛一個(gè)理想的32位DDR模型(有訪問(wèn)請(qǐng)求立即響應(yīng),沒(méi)有延時(shí)),CPU頻率為1008MHz時(shí),測(cè)得數(shù)據(jù)拷貝帶寬為2140 MB/s。

一般會(huì)配置540MHz 32位DDR,能提供的理論帶寬為4320MB/s,已經(jīng)遠(yuǎn)超cortex-A9的帶寬吞吐能力了,這種情況下帶寬性能測(cè)試得到的只是CPU的訪存性能,而不是DDR的總體帶寬性能。 現(xiàn)在的帶寬吞吐性能評(píng)測(cè)軟件都是利用統(tǒng)計(jì)CPU訪問(wèn)DDR的速度來(lái)評(píng)估芯片總的帶寬吞吐性能,這就需要考慮CPU Cache的影響。

I/O端口存在讀、寫(xiě)性問(wèn)題,有的端口是只讀的,有的端口是只寫(xiě)的,還有的端口是即可讀也可寫(xiě),其讀寫(xiě)性是由外設(shè)芯片的寄存器所決定的,在芯片的數(shù)據(jù)手冊(cè)中能找到。

存儲(chǔ)器外設(shè)也存在I/O端口,以對(duì)其進(jìn)行一定的控制。從I/O端口這一名字來(lái)看,對(duì)于處理器來(lái)說(shuō),就是對(duì)從外面讀入數(shù)據(jù)或是向外面輸出數(shù)據(jù)的一個(gè)接口總稱(chēng)。

與存儲(chǔ)器外設(shè)所不同的是,I/O外設(shè)所點(diǎn)用的地址一般都很少。比如一個(gè)I/O外設(shè)可能存在多個(gè)控制寄存器,這些控制寄存器從處理器來(lái)看就是多個(gè)I/O端口(地址),向這個(gè)地址寫(xiě)數(shù)據(jù)就是向外設(shè)所對(duì)應(yīng)的寄存器寫(xiě)數(shù)據(jù),反之,也可以是讀。


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