1.1mm的爬電距離滿足UL 840規(guī)范的120V AC無(wú)涂層絕緣要求
發(fā)布時(shí)間:2024/6/12 8:57:14 訪問(wèn)次數(shù):145
X0115ML是ST為接地故障斷路器 (GFCI) 和電弧故障斷路器(AFCI)設(shè)計(jì)的首款斷態(tài)浪涌峰值電壓750V的緊湊型可控硅整流器(SCR),SOT23-3L微型封裝 (2.75mmx3.10mm).
最小的晶閘管,工程師可以節(jié)約很大的電路板空間,同時(shí)讓工業(yè)應(yīng)用具有600V的斷態(tài)重復(fù)峰值電壓。此外,1.1mm的爬電距離滿足UL 840規(guī)范的120V AC無(wú)涂層絕緣要求。
在這種情況下,GFCI 就會(huì)使火線和零線之間的電路跳閘,中斷電流。
IBIS模型不僅能表示元器件的箝位行為和驅(qū)動(dòng)強(qiáng)度,還能表示數(shù)字輸入/輸出(I/O)緩沖器的阻抗,包括驅(qū)動(dòng)器和/或接收器的輸出和輸入阻抗。
這些并未在模型中直接說(shuō)明,但都隱含在表示元器件行為的I-V數(shù)據(jù)中。
另一方面,在制造電路板之前進(jìn)行信號(hào)完整性仿真期間,也往往會(huì)遇到反射問(wèn)題。眾所周知,當(dāng)輸入或輸出緩沖器的阻抗與走線的特性阻抗不匹配時(shí),就會(huì)發(fā)生反射。理想情況下,進(jìn)入器件并沿走線傳播的信號(hào)應(yīng)在沒(méi)有任何干擾的情況下傳輸?shù)阶呔的另一端。
電壓監(jiān)視器或監(jiān)控電路可以為其邏輯電平輸出提供兩種選擇:低電平有效和高電平有效輸出信號(hào)。
前者“低電平有效”是指當(dāng)輸入條件為真且得到滿足時(shí),輸出置為低電平;而當(dāng)輸入條件為假時(shí),輸出置為高電平。后者“高電平有效”是指當(dāng)輸入條件為真時(shí),輸出置為高電平;而當(dāng)輸入條件為假且未得到滿足時(shí),輸出置為低電平。
監(jiān)控電路常用于復(fù)位微控制器,因此故障期間會(huì)使用低電平有效輸出將微控制器的復(fù)位引腳拉低。利用高電平有效輸出驅(qū)動(dòng)P溝道MOSFET非常簡(jiǎn)單,對(duì)于開(kāi)漏拓?fù)鋪?lái)說(shuō)尤為如此。
深圳市裕碩科技有限公司http://yushuo.51dzw.com
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最小的晶閘管,工程師可以節(jié)約很大的電路板空間,同時(shí)讓工業(yè)應(yīng)用具有600V的斷態(tài)重復(fù)峰值電壓。此外,1.1mm的爬電距離滿足UL 840規(guī)范的120V AC無(wú)涂層絕緣要求。
在這種情況下,GFCI 就會(huì)使火線和零線之間的電路跳閘,中斷電流。
IBIS模型不僅能表示元器件的箝位行為和驅(qū)動(dòng)強(qiáng)度,還能表示數(shù)字輸入/輸出(I/O)緩沖器的阻抗,包括驅(qū)動(dòng)器和/或接收器的輸出和輸入阻抗。
這些并未在模型中直接說(shuō)明,但都隱含在表示元器件行為的I-V數(shù)據(jù)中。
另一方面,在制造電路板之前進(jìn)行信號(hào)完整性仿真期間,也往往會(huì)遇到反射問(wèn)題。眾所周知,當(dāng)輸入或輸出緩沖器的阻抗與走線的特性阻抗不匹配時(shí),就會(huì)發(fā)生反射。理想情況下,進(jìn)入器件并沿走線傳播的信號(hào)應(yīng)在沒(méi)有任何干擾的情況下傳輸?shù)阶呔的另一端。
電壓監(jiān)視器或監(jiān)控電路可以為其邏輯電平輸出提供兩種選擇:低電平有效和高電平有效輸出信號(hào)。
前者“低電平有效”是指當(dāng)輸入條件為真且得到滿足時(shí),輸出置為低電平;而當(dāng)輸入條件為假時(shí),輸出置為高電平。后者“高電平有效”是指當(dāng)輸入條件為真時(shí),輸出置為高電平;而當(dāng)輸入條件為假且未得到滿足時(shí),輸出置為低電平。
監(jiān)控電路常用于復(fù)位微控制器,因此故障期間會(huì)使用低電平有效輸出將微控制器的復(fù)位引腳拉低。利用高電平有效輸出驅(qū)動(dòng)P溝道MOSFET非常簡(jiǎn)單,對(duì)于開(kāi)漏拓?fù)鋪?lái)說(shuō)尤為如此。
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