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使用CMOS型集成電路時應(yīng)注意哪些問題

發(fā)布時間:2008/6/3 0:00:00 訪問次數(shù):784

  cmos器件(集成電路),即金屬-氧化物-半導(dǎo)體器件,是用一層極薄的(數(shù)微米)二氧化硅材料做為電極的絕緣層。如果電極上有較高的電壓,絕緣層易被擊穿而損壞。因此使用cmos器件應(yīng)注意以下幾個問題:

  1)手拿cmos器件時,應(yīng)拿芯片的兩頭,盡量避免碰其管腳。

  2)在焊接中,cmos器件應(yīng)盡量使用集成電路插座,待整機都焊完后再插入cmos集成電路。

  3)保存cmos器件時;應(yīng)插在導(dǎo)電泡沫橡膠上或用錫箔紙包好。

  4)cmos器件的電源電壓應(yīng)在3-18v,并且其電源壓、負極不能接反,否則可能會燒壞cmos集成電路。

  5)cmos器件輸入端不能懸空,必須與邏輯電路輸出端相連,或按邏輯要求經(jīng)電阻器接臨d(電源正極)或vss(電源負極),否則會由于感應(yīng)靜電,或各種脈沖信號造成干擾,破壞電路邏輯狀態(tài),甚至損壞集成電路。在74ls系列數(shù)字集成電路制作中,空閑的輸入端可以懸空,且為"1"狀態(tài);但對于cmos集成電路,輸入端懸空時,其電平處于不穩(wěn)定狀態(tài),使電路無法正常工作。

  6)在末加電源電壓的情況下,不允許在cmos集成電路輸人瑞接人信號。開機時應(yīng)先加電源電壓,再加輸入信號;關(guān)機時,應(yīng)先關(guān)掉輸入信號,再切斷電源。

  7)cmos集成電路輸出端不允許與vdd或vss,直接短接。一般情況下,不同的集成電路輸出端不得直接并聯(lián),但對于同一塊集成電路功能相同的輸出端,為了增加驅(qū)動能力可以并接。

  8)在插拔cmos器件時,應(yīng)撥下交流供電電源或測試儀表的電源插頭,而且盡可能不要觸摸集成電路的輸入端。

  9)cmos器件一般輸出電流驅(qū)動能力都比較小,若直接驅(qū)動發(fā)光二極管,其工作電流不能像74ls系列那樣大,或者可以采用相同功能輸出端并聯(lián)的方法,提高驅(qū)動能力。

  1o)cmos集成電路的輸入端電壓不應(yīng)超過電源電壓vdd或低于地電位;輸入端電流的最大定額為10ma,如果有n個輸入端,每個輸入端電流應(yīng)小于n/10ma.



  cmos器件(集成電路),即金屬-氧化物-半導(dǎo)體器件,是用一層極薄的(數(shù)微米)二氧化硅材料做為電極的絕緣層。如果電極上有較高的電壓,絕緣層易被擊穿而損壞。因此使用cmos器件應(yīng)注意以下幾個問題:

  1)手拿cmos器件時,應(yīng)拿芯片的兩頭,盡量避免碰其管腳。

  2)在焊接中,cmos器件應(yīng)盡量使用集成電路插座,待整機都焊完后再插入cmos集成電路。

  3)保存cmos器件時;應(yīng)插在導(dǎo)電泡沫橡膠上或用錫箔紙包好。

  4)cmos器件的電源電壓應(yīng)在3-18v,并且其電源壓、負極不能接反,否則可能會燒壞cmos集成電路。

  5)cmos器件輸入端不能懸空,必須與邏輯電路輸出端相連,或按邏輯要求經(jīng)電阻器接臨d(電源正極)或vss(電源負極),否則會由于感應(yīng)靜電,或各種脈沖信號造成干擾,破壞電路邏輯狀態(tài),甚至損壞集成電路。在74ls系列數(shù)字集成電路制作中,空閑的輸入端可以懸空,且為"1"狀態(tài);但對于cmos集成電路,輸入端懸空時,其電平處于不穩(wěn)定狀態(tài),使電路無法正常工作。

  6)在末加電源電壓的情況下,不允許在cmos集成電路輸人瑞接人信號。開機時應(yīng)先加電源電壓,再加輸入信號;關(guān)機時,應(yīng)先關(guān)掉輸入信號,再切斷電源。

  7)cmos集成電路輸出端不允許與vdd或vss,直接短接。一般情況下,不同的集成電路輸出端不得直接并聯(lián),但對于同一塊集成電路功能相同的輸出端,為了增加驅(qū)動能力可以并接。

  8)在插拔cmos器件時,應(yīng)撥下交流供電電源或測試儀表的電源插頭,而且盡可能不要觸摸集成電路的輸入端。

  9)cmos器件一般輸出電流驅(qū)動能力都比較小,若直接驅(qū)動發(fā)光二極管,其工作電流不能像74ls系列那樣大,或者可以采用相同功能輸出端并聯(lián)的方法,提高驅(qū)動能力。

  1o)cmos集成電路的輸入端電壓不應(yīng)超過電源電壓vdd或低于地電位;輸入端電流的最大定額為10ma,如果有n個輸入端,每個輸入端電流應(yīng)小于n/10ma.



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