EDA典型單元電路的FIFO圖
發(fā)布時(shí)間:2008/10/13 0:00:00 訪問(wèn)次數(shù):489
fifo是先進(jìn)先出堆棧,作為數(shù)據(jù)緩沖器,通常其數(shù)據(jù)存放結(jié)構(gòu)完全與ram一致,只是存取方式有所不同。
【例】 設(shè)計(jì)一個(gè)8×8先進(jìn)先出堆棧fifo的vhdl程序,并使用max+p1us ⅱ進(jìn)行仿真。
仿真結(jié)果如圖示。
如圖 先進(jìn)先出棧myfif0仿真圖
歡迎轉(zhuǎn)載,信息來(lái)自維庫(kù)電子市場(chǎng)網(wǎng)(www.dzsc.com)
fifo是先進(jìn)先出堆棧,作為數(shù)據(jù)緩沖器,通常其數(shù)據(jù)存放結(jié)構(gòu)完全與ram一致,只是存取方式有所不同。
【例】 設(shè)計(jì)一個(gè)8×8先進(jìn)先出堆棧fifo的vhdl程序,并使用max+p1us ⅱ進(jìn)行仿真。
仿真結(jié)果如圖示。
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