二極管與門(mén)電路工作狀況
發(fā)布時(shí)間:2011/9/6 10:38:55 訪(fǎng)問(wèn)次數(shù):2875
(一)二極管與門(mén)電路是怎樣工作的? G64128A09BBW00
圖ll-l(a)是由二極管組成的與門(mén)電路,A、B是它的兩個(gè)輸入端,F(xiàn)是輸出端。圖(b)是它的邏輯符號(hào)。
設(shè)輸入信號(hào)電壓為3V(高電平1)或OV(低電平O),二極管為理想元件,則電路的工作原理如下。
當(dāng)輸入端A、B都為高電平1時(shí),二極管VDA、VDB均處于正向?qū)顟B(tài),輸出端F為高電平(3V)。
當(dāng)輸入端A、B都為低電平O時(shí),二極管VDA、VDB亦處于正向?qū)顟B(tài),輸出端F為低電平(OV)。
當(dāng)輸入端一端為高電平、另一端為低電平時(shí),例如A端為3V,B端為OV,則VDB優(yōu)先導(dǎo)通,輸出端F被鉗制在OV,輸出為低電平。在VDB的鉗位作用下,VDA處于截止?fàn)顟B(tài)。
由上述可知,與門(mén)電路的輸入端中只要有一個(gè)為低電平,輸出端就是低電平,只有輸入端全為高電平時(shí),輸出端才是高電平。其真值表如表11—1所示。
由真值表可得出與門(mén)電路的邏輯表達(dá)式
F=A·B
(二)二極管或門(mén)電路是怎樣工作的? R3111H601A-T1
圖ll-3(a)是由二極管組成的或門(mén)電路,A、B為輸入端,F(xiàn)是輸出端。圖(b)是或門(mén)的邏輯符號(hào)。工作原理分析如下。
當(dāng)輸入端A、B都處于高電平1(3V)時(shí),則VDA、VDB都處于正向?qū)顟B(tài),輸出端F為高電平1(3V)。
當(dāng)輸入端A、B都處于低電平O(OV)時(shí),則VDA、VDB亦都正向?qū),輸出端F為低電平O(OV)。
當(dāng)輸入端一端為高電平,而另一端為低電平時(shí),例如A端為3V,B端為OV。此時(shí)VDA管優(yōu)先導(dǎo)通,輸出端F被鉗制在3V,使輸出端F為高電平。同時(shí)VDB管受反向偏置而截止。
由上述可知,在或門(mén)電路的輸入端中,只要有一端為高電平,輸出端F就是高電平,只有輸入端全為低電平時(shí),輸出端F才為低電平,即具有或邏輯關(guān)系。其真值表如表11-2所示。
由真值表可得出其邏輯表達(dá)式
F=A+B
圖11-4是或門(mén)電路的波形圖。
(一)二極管與門(mén)電路是怎樣工作的? G64128A09BBW00
圖ll-l(a)是由二極管組成的與門(mén)電路,A、B是它的兩個(gè)輸入端,F(xiàn)是輸出端。圖(b)是它的邏輯符號(hào)。
設(shè)輸入信號(hào)電壓為3V(高電平1)或OV(低電平O),二極管為理想元件,則電路的工作原理如下。
當(dāng)輸入端A、B都為高電平1時(shí),二極管VDA、VDB均處于正向?qū)顟B(tài),輸出端F為高電平(3V)。
當(dāng)輸入端A、B都為低電平O時(shí),二極管VDA、VDB亦處于正向?qū)顟B(tài),輸出端F為低電平(OV)。
當(dāng)輸入端一端為高電平、另一端為低電平時(shí),例如A端為3V,B端為OV,則VDB優(yōu)先導(dǎo)通,輸出端F被鉗制在OV,輸出為低電平。在VDB的鉗位作用下,VDA處于截止?fàn)顟B(tài)。
由上述可知,與門(mén)電路的輸入端中只要有一個(gè)為低電平,輸出端就是低電平,只有輸入端全為高電平時(shí),輸出端才是高電平。其真值表如表11—1所示。
由真值表可得出與門(mén)電路的邏輯表達(dá)式
F=A·B
(二)二極管或門(mén)電路是怎樣工作的? R3111H601A-T1
圖ll-3(a)是由二極管組成的或門(mén)電路,A、B為輸入端,F(xiàn)是輸出端。圖(b)是或門(mén)的邏輯符號(hào)。工作原理分析如下。
當(dāng)輸入端A、B都處于高電平1(3V)時(shí),則VDA、VDB都處于正向?qū)顟B(tài),輸出端F為高電平1(3V)。
當(dāng)輸入端A、B都處于低電平O(OV)時(shí),則VDA、VDB亦都正向?qū),輸出端F為低電平O(OV)。
當(dāng)輸入端一端為高電平,而另一端為低電平時(shí),例如A端為3V,B端為OV。此時(shí)VDA管優(yōu)先導(dǎo)通,輸出端F被鉗制在3V,使輸出端F為高電平。同時(shí)VDB管受反向偏置而截止。
由上述可知,在或門(mén)電路的輸入端中,只要有一端為高電平,輸出端F就是高電平,只有輸入端全為低電平時(shí),輸出端F才為低電平,即具有或邏輯關(guān)系。其真值表如表11-2所示。
由真值表可得出其邏輯表達(dá)式
F=A+B
圖11-4是或門(mén)電路的波形圖。
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