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參數(shù)擬合技術(shù)

發(fā)布時(shí)間:2012/3/31 20:47:35 訪問(wèn)次數(shù):1014

    參數(shù)擬合技術(shù)可以同時(shí)計(jì)算出節(jié)點(diǎn)時(shí)UAF05-12304-1501鐘之間的頻率偏移和相位偏移。假設(shè)兩時(shí)鐘的時(shí)間之間滿(mǎn)足式(4-34):

                          
 
    其中,兄和f分別是兩個(gè)時(shí)鐘時(shí)間之間的相對(duì)頻率偏移和相位偏移。采用上述3種方法測(cè)量節(jié)點(diǎn)間時(shí)間偏差,在測(cè)量得到多組數(shù)捃樣本后,就可以利用參數(shù)擬合技術(shù)計(jì)算時(shí)間的頻偏和相偏。
    參數(shù)擬合技術(shù)有以下兩種實(shí)現(xiàn)方法[15]:
    ①線性回歸。線性回歸是最普遍應(yīng)用的技術(shù),該技術(shù)只有單獨(dú)一個(gè)參數(shù),即負(fù)責(zé)計(jì)算系數(shù)的樣本數(shù)。大樣本能提高線性回歸的精確度,但需要大的存儲(chǔ)空間。線性回歸能夠隱含地補(bǔ)償時(shí)鐘頻率偏移。線性回歸可以在線計(jì)算,即一旦得到一個(gè)新樣本,就可以增加樣本數(shù)隨時(shí)計(jì)算。但是它是通過(guò)數(shù)據(jù)與最合適直線的方差來(lái)決定數(shù)據(jù)好壞的方法,使得外來(lái)數(shù)據(jù)對(duì)系數(shù)估計(jì)影響很大。
    ②鎖相環(huán)。另一種處理連續(xù)樣本的方法就是基于鎖相環(huán)( Phased-Locked Loops,PLL)的方法。鎖相環(huán)用比例積分(PI)控制器來(lái)控制插值的斜度。PI控制器的輸出是具有線性控制特性的環(huán)路濾波器和具有整體線性控制的壓控振蕩器輸入,控制器的輸入是實(shí)際參數(shù)和插值之間的差。如果插值小于樣本參數(shù),則增加它的斜率,否則減少。基于PLL同步方法的主要優(yōu)點(diǎn)在于它只需要存儲(chǔ)當(dāng)前積分和的狀態(tài),因而比線性回歸所需要的存儲(chǔ)空間少得多。它的主要缺點(diǎn)是PLL需要很長(zhǎng)的收斂時(shí)間才能達(dá)到穩(wěn)態(tài)。

    參數(shù)擬合技術(shù)可以同時(shí)計(jì)算出節(jié)點(diǎn)時(shí)UAF05-12304-1501鐘之間的頻率偏移和相位偏移。假設(shè)兩時(shí)鐘的時(shí)間之間滿(mǎn)足式(4-34):

                          
 
    其中,兄和f分別是兩個(gè)時(shí)鐘時(shí)間之間的相對(duì)頻率偏移和相位偏移。采用上述3種方法測(cè)量節(jié)點(diǎn)間時(shí)間偏差,在測(cè)量得到多組數(shù)捃樣本后,就可以利用參數(shù)擬合技術(shù)計(jì)算時(shí)間的頻偏和相偏。
    參數(shù)擬合技術(shù)有以下兩種實(shí)現(xiàn)方法[15]:
    ①線性回歸。線性回歸是最普遍應(yīng)用的技術(shù),該技術(shù)只有單獨(dú)一個(gè)參數(shù),即負(fù)責(zé)計(jì)算系數(shù)的樣本數(shù)。大樣本能提高線性回歸的精確度,但需要大的存儲(chǔ)空間。線性回歸能夠隱含地補(bǔ)償時(shí)鐘頻率偏移。線性回歸可以在線計(jì)算,即一旦得到一個(gè)新樣本,就可以增加樣本數(shù)隨時(shí)計(jì)算。但是它是通過(guò)數(shù)據(jù)與最合適直線的方差來(lái)決定數(shù)據(jù)好壞的方法,使得外來(lái)數(shù)據(jù)對(duì)系數(shù)估計(jì)影響很大。
    ②鎖相環(huán)。另一種處理連續(xù)樣本的方法就是基于鎖相環(huán)( Phased-Locked Loops,PLL)的方法。鎖相環(huán)用比例積分(PI)控制器來(lái)控制插值的斜度。PI控制器的輸出是具有線性控制特性的環(huán)路濾波器和具有整體線性控制的壓控振蕩器輸入,控制器的輸入是實(shí)際參數(shù)和插值之間的差。如果插值小于樣本參數(shù),則增加它的斜率,否則減少;赑LL同步方法的主要優(yōu)點(diǎn)在于它只需要存儲(chǔ)當(dāng)前積分和的狀態(tài),因而比線性回歸所需要的存儲(chǔ)空間少得多。它的主要缺點(diǎn)是PLL需要很長(zhǎng)的收斂時(shí)間才能達(dá)到穩(wěn)態(tài)。

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