測試并驗證邏輯功能
發(fā)布時間:2014/2/15 19:23:39 訪問次數(shù):1579
操作方法與說明:
(1)J,K,RtD,StD接電平給定開關(guān)插孔,Q接電平顯示插孑L,CLK接單脈沖插孑L,NLV32T-820J-PF按功能表(見表3.3.1)測試并驗證邏輯功能。
(2)R乞是給輸出Q置“0”的,S,D是給輸出Q置“1”的,均為低電平有效。
(3)RD和S;)可以同為高電平,表示不置數(shù)。R:和S:不能同為低電平,既置“o”又置“1”,這是禁止的。
(4)Q’是觸發(fā)器被觸發(fā)后的Q端狀態(tài)。
(5)當RD是低電平時,輸出Q被置為“0”,其操作L一H表示用低電平給輸出置“0”后必須回到高電平,觸發(fā)器才能被觸發(fā),否則輸出將被鎖定在“O”狀態(tài)。同樣,當S;)是低電平時,輸出Q被置為“1”,其操作L—H表示用低電平給輸出置“1”后必須回到高電平,觸發(fā)器才能被觸發(fā),否則輸出將被鎖定在“1”狀態(tài)。
驗證D觸發(fā)器的邏輯功能
方法同JK觸發(fā)器功能驗證。
要求:按照表3.3.2完成功能表Q*的測試,總結(jié)功能,填注說明。
表3.3.2 74LS74 -D觖發(fā)器邏輯功能表
操作方法與說明:
(1)J,K,RtD,StD接電平給定開關(guān)插孔,Q接電平顯示插孑L,CLK接單脈沖插孑L,NLV32T-820J-PF按功能表(見表3.3.1)測試并驗證邏輯功能。
(2)R乞是給輸出Q置“0”的,S,D是給輸出Q置“1”的,均為低電平有效。
(3)RD和S;)可以同為高電平,表示不置數(shù)。R:和S:不能同為低電平,既置“o”又置“1”,這是禁止的。
(4)Q’是觸發(fā)器被觸發(fā)后的Q端狀態(tài)。
(5)當RD是低電平時,輸出Q被置為“0”,其操作L一H表示用低電平給輸出置“0”后必須回到高電平,觸發(fā)器才能被觸發(fā),否則輸出將被鎖定在“O”狀態(tài)。同樣,當S;)是低電平時,輸出Q被置為“1”,其操作L—H表示用低電平給輸出置“1”后必須回到高電平,觸發(fā)器才能被觸發(fā),否則輸出將被鎖定在“1”狀態(tài)。
驗證D觸發(fā)器的邏輯功能
方法同JK觸發(fā)器功能驗證。
要求:按照表3.3.2完成功能表Q*的測試,總結(jié)功能,填注說明。
表3.3.2 74LS74 -D觖發(fā)器邏輯功能表
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