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利用PSpice提供的直流工作點(diǎn)分析(Bias Point)工具2015/8/27 22:01:21
2015/8/27 22:01:21
利用PSpice提供的直流工作點(diǎn)分析(BiasPoint)工具,得到圖5.3.1中各三極管的靜態(tài)工作點(diǎn),ACPL-054L-000E觀察各三極管是否均工作在放大區(qū)。兩...[全文]
進(jìn)程Process2015/8/26 20:47:56
2015/8/26 20:47:56
進(jìn)程用于描述順序事件并且包含在結(jié)構(gòu)中,一個(gè)結(jié)構(gòu)體可以包含多個(gè)進(jìn)程語句。DGB1010K以下為進(jìn)程語句的構(gòu)成:以下為進(jìn)程語句的語法描述:<optional_lab...[全文]
VHDL的基本語法2015/8/26 20:43:47
2015/8/26 20:43:47
VHDL語言的客體及其分類.在VHDL語言中凡是可以賦予一個(gè)值的對(duì)象就稱為客體(Object)。D25K400E客體主要包括信號(hào)、常數(shù)、變量3種。在電子線路中,這3類客體通常都具有...[全文]
設(shè)計(jì)校驗(yàn)是指對(duì)上述邏輯設(shè)計(jì)進(jìn)行仿真和測(cè)試2015/8/25 20:40:07
2015/8/25 20:40:07
設(shè)計(jì)校驗(yàn)是指對(duì)上述邏輯設(shè)計(jì)進(jìn)行仿真和測(cè)試,以驗(yàn)證邏輯設(shè)計(jì)是否滿足設(shè)計(jì)功能要求。M25P32V6它與設(shè)計(jì)過程同步進(jìn)行,包括功能仿真、時(shí)序仿真和器件測(cè)試。(1)功能仿真功...[全文]
PLD的設(shè)計(jì)流程圖2015/8/25 20:37:45
2015/8/25 20:37:45
(1)設(shè)計(jì)分析設(shè)計(jì)分析是指在利用PLD進(jìn)行數(shù)字系統(tǒng)設(shè)計(jì)之前,M25P16VP根據(jù)PLD開發(fā)環(huán)境及設(shè)計(jì)要求(如系統(tǒng)復(fù)雜度、工作頻率、功耗、引腳數(shù)、封裝形式及成本等),選擇適當(dāng)?shù)脑O(shè)計(jì)方...[全文]
低密度PLD的集成度較低2015/8/25 20:34:38
2015/8/25 20:34:38
低密度PLD的集成度較低,每個(gè)芯片集成的邏輯門數(shù)大約在1000門以下,早期出M12L128168A-7T現(xiàn)的可編程只讀存儲(chǔ)器(PROM)、可編程邏輯陣列(ProgrammableLogicArr...[全文]
最壞情況分析的文本結(jié)果2015/8/25 20:27:48
2015/8/25 20:27:48
分析結(jié)果顯示。①波形顯示:在“MoreSetting”中“Worst-casedirection”選擇“Hi”時(shí),M11B16161A-45T輸出波形如圖4.3.32(a)所示,下...[全文]
輸出變量的確定2015/8/24 21:19:10
2015/8/24 21:19:10
(1)輸出變量的確定:BT868KRF/25868在“Outputvariable”右側(cè)的編輯欄中輸入最壞情況分析中的輸出變量名。(2)選擇不同容差模式的元器件:在“Varydev...[全文]
電路仿真和分析步驟2015/8/23 17:50:21
2015/8/23 17:50:21
創(chuàng)建仿真項(xiàng)目軟件正確安裝后,HD6417604F28從計(jì)算機(jī)桌面的開始菜單進(jìn)入程序中找到Cadence目錄,展開release16.6的文件夾,單擊OrCADCapture或OrC...[全文]
獨(dú)立電源建模對(duì)話框2015/8/23 17:43:48
2015/8/23 17:43:48
16.6版本在2013年上半年推出了“16.6QuarterlyIncrementalRelease”(16.6QIR),HD6417095F28增加了多種建模應(yīng)用工具,可以直接在Capture...[全文]
PSpice Advanced Analysis (AA)2015/8/23 17:31:54
2015/8/23 17:31:54
PSpice的高級(jí)仿真工具,HD6413006F20V界面如圖4.1.2所示。它以PSpiceA/D分析為基礎(chǔ),通過高級(jí)分析工具來提高設(shè)計(jì)電路的性能及可靠性。PSpiceAA中的Optimize...[全文]
變?nèi)荻䴓O管調(diào)頻實(shí)驗(yàn)2015/8/22 17:58:22
2015/8/22 17:58:22
一、實(shí)驗(yàn)?zāi)康?.加深對(duì)變?nèi)荻䴓O管頻率調(diào)制電路工作原理的理解。2.掌握調(diào)頻電路的調(diào)試方法及其特性、參數(shù)的C8051F321-GM測(cè)量方法。二、實(shí)驗(yàn)原理...[全文]
觀察串聯(lián)電流負(fù)反饋電阻RW4對(duì)輸出中頻信號(hào)的影響2015/8/22 17:51:44
2015/8/22 17:51:44
觀察串聯(lián)電流負(fù)反饋電阻RW4對(duì)輸出中頻信號(hào)的影響調(diào)節(jié)RW2,C-51847NFJ-SLW-AEN使VLm=500mV,調(diào)節(jié)Rws,使厶=0.6mA,使信號(hào)發(fā)生器輸出高頻調(diào)幅信號(hào)Vs...[全文]
包絡(luò)失真與輸入信號(hào)幅度及本振電壓大小的關(guān)系2015/8/22 17:45:33
2015/8/22 17:45:33
包絡(luò)失真與輸入信號(hào)幅度及本振電壓大小的關(guān)系使信號(hào)發(fā)生器輸出一個(gè)調(diào)制頻率為1kHz、調(diào)制系數(shù)為30%的調(diào)幅信號(hào),C2073送入混頻器的VS輸入端,將示波器接在實(shí)驗(yàn)板的輸出端,觀察其包...[全文]
靜態(tài)工作點(diǎn)的影響2015/8/21 22:47:14
2015/8/21 22:47:14
合理地選擇靜態(tài)工作點(diǎn),AD674BBD對(duì)振蕩器工作的穩(wěn)定性歿波形好壞有著密切關(guān)系。當(dāng)振蕩穩(wěn)定下來后,振蕩器必然工作在非線性區(qū)域,可能進(jìn)入截止區(qū),也可能進(jìn)入飽和區(qū)。當(dāng)進(jìn)入飽和區(qū)時(shí),輸出波形將產(chǎn)生失...[全文]
起振條件2015/8/21 22:46:11
2015/8/21 22:46:11
前面已經(jīng)提到,AD674BAD振蕩器的起振條件為兩個(gè):相位起振條件和幅度起振條件。而在LC振蕩電路——三點(diǎn)式振蕩電路中,相位起振條件表現(xiàn)為蜀與X2應(yīng)為同性質(zhì)電抗(在電容三點(diǎn)式中應(yīng)為...[全文]
石英晶體多諧振蕩器2015/8/21 22:31:11
2015/8/21 22:31:11
由555定時(shí)器構(gòu)成的多諧振蕩器結(jié)構(gòu)簡(jiǎn)單,使用靈活,電源電壓范圍寬,調(diào)節(jié)方便;AD673KD但缺點(diǎn)是電路的振蕩頻率取決于時(shí)間常數(shù)RC、轉(zhuǎn)換電平及電源電壓等參數(shù),導(dǎo)致輸出頻率穩(wěn)定性較低。在一...[全文]
異步清零2015/8/20 20:11:31
2015/8/20 20:11:31
由表2.5.1可知,74LS194具有以下功能:①異步清零:只要CLR-0,A80386DX20不管其他輸入端的狀態(tài)如何,也不論有無時(shí)鐘脈沖CLK作用,移位寄存器74LS194都將...[全文]
將JK觸發(fā)器轉(zhuǎn)換為T觸發(fā)器2015/8/20 19:54:05
2015/8/20 19:54:05
1.將JK觸發(fā)器轉(zhuǎn)換為T觸發(fā)器,畫出邏輯電踣圖。2.用74LS112JK觸發(fā)器和少量門電路設(shè)計(jì)能夠自啟動(dòng)的同步可逆模5計(jì)數(shù)器,A179B33K其有效狀態(tài)轉(zhuǎn)換圖如圖2.3.14所示,...[全文]
共源電路的電壓放大倍數(shù)2015/8/19 20:59:53
2015/8/19 20:59:53
共源極電路,相當(dāng)于雙極晶體管AD7305B的共發(fā)射極電路。當(dāng)交流信號(hào)Ui經(jīng)C,加到柵一源極時(shí),使柵極偏壓隨信號(hào)而變,于是控制了ID的變化,在RL上產(chǎn)生壓降,通過C2將放大了的信號(hào)電壓輸出。...[全文]
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