KMPC8264AZUQJDBTTL邏輯門電路
發(fā)布時(shí)間:2019/10/12 17:53:00 訪問(wèn)次數(shù):1397
KMPC8264AZUQJDBTTL系列邏輯門電路中-除上述介紹的非門外,還有與非門、或非門和與或非門等其他門電路,下面仍以74系列為例,分別加以介紹。
與非門電路,將基本TTL反相器的輸人級(jí)TI改成為多發(fā)射極的BJT,就構(gòu)成了與非門,如圖3.2.6所示。在P型的基區(qū)上擴(kuò)散兩個(gè)高濃度的N型區(qū),形成彼此獨(dú)立的兩個(gè)發(fā)射極,而基區(qū)和集電區(qū)是公用的。
圖3.2.7所示為采用多發(fā)射極BJT構(gòu)成的2輸入端TTL與非門。當(dāng)任一輸入端為低 圖3.2.6 NPN型多發(fā)射極BJT的電平時(shí),T1的發(fā)射結(jié)將正向偏置而導(dǎo)通, 其基極電壓為UB1=0.9V。所以T2、T3都截止,輸出為高電平。只有當(dāng)全部輸人端為高電平時(shí),T1將轉(zhuǎn)人倒置放大狀態(tài),T2和T3均飽和,輸出為低電平。
或非門電路,圖3.2.8所示為TL或非門邏輯電路。圖中T1A、T2A和R1A組成的電路與T1A、T2A和R1A組成的電路相同。若A、B兩輸人端均為低電平,則T2A和T2B均將截止,IB3=0,T3截止。同時(shí),UC2為高電平,使T4和D飽和導(dǎo)通,輸出為高電平。若A、B兩輸人端中有一個(gè)為高電平,則T從或T2B將飽和,導(dǎo)致IB3>0,IB3使T3飽和,T4截止,輸出為低電平。這就實(shí)現(xiàn)了或非功能,即L=A+B。
將或非門的兩個(gè)輸入管T1A和T1B改成多發(fā)射極的BJT,就可構(gòu)成與或非門電路,讀者可自行分析。
集電極開路門和三態(tài)門電路
與CMOs邏輯門電路類似,TTL門電路也有另外兩種不同輸出結(jié)構(gòu)形式的電路,集電極開路門和三態(tài)輸出門,下面分別加以討論。
KMPC8264AZUQJDBTTL系列邏輯門電路中-除上述介紹的非門外,還有與非門、或非門和與或非門等其他門電路,下面仍以74系列為例,分別加以介紹。
與非門電路,將基本TTL反相器的輸人級(jí)TI改成為多發(fā)射極的BJT,就構(gòu)成了與非門,如圖3.2.6所示。在P型的基區(qū)上擴(kuò)散兩個(gè)高濃度的N型區(qū),形成彼此獨(dú)立的兩個(gè)發(fā)射極,而基區(qū)和集電區(qū)是公用的。
圖3.2.7所示為采用多發(fā)射極BJT構(gòu)成的2輸入端TTL與非門。當(dāng)任一輸入端為低 圖3.2.6 NPN型多發(fā)射極BJT的電平時(shí),T1的發(fā)射結(jié)將正向偏置而導(dǎo)通, 其基極電壓為UB1=0.9V。所以T2、T3都截止,輸出為高電平。只有當(dāng)全部輸人端為高電平時(shí),T1將轉(zhuǎn)人倒置放大狀態(tài),T2和T3均飽和,輸出為低電平。
或非門電路,圖3.2.8所示為TL或非門邏輯電路。圖中T1A、T2A和R1A組成的電路與T1A、T2A和R1A組成的電路相同。若A、B兩輸人端均為低電平,則T2A和T2B均將截止,IB3=0,T3截止。同時(shí),UC2為高電平,使T4和D飽和導(dǎo)通,輸出為高電平。若A、B兩輸人端中有一個(gè)為高電平,則T從或T2B將飽和,導(dǎo)致IB3>0,IB3使T3飽和,T4截止,輸出為低電平。這就實(shí)現(xiàn)了或非功能,即L=A+B。
將或非門的兩個(gè)輸入管T1A和T1B改成多發(fā)射極的BJT,就可構(gòu)成與或非門電路,讀者可自行分析。
集電極開路門和三態(tài)門電路
與CMOs邏輯門電路類似,TTL門電路也有另外兩種不同輸出結(jié)構(gòu)形式的電路,集電極開路門和三態(tài)輸出門,下面分別加以討論。
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