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SMD2920P300TF激勵(lì)方程組和輸出方程組

發(fā)布時(shí)間:2019/10/17 21:12:45 訪問(wèn)次數(shù):2508

SMD2920P300TF選擇觸發(fā)器類(lèi)型用小規(guī)模集成的觸發(fā)器芯片設(shè)計(jì)時(shí)序電路時(shí) ,選用邏輯功能較強(qiáng)的JK觸發(fā)器可能得到較簡(jiǎn)化的組合電路 。

確定激勵(lì)方程組和輸出方程組

用JK觸發(fā)器設(shè)計(jì)時(shí)序電路時(shí) ,電路的激勵(lì)方程需要間接導(dǎo)出。表5.4.2所示的JK觸發(fā)器特性表提供了在不同現(xiàn)態(tài)和輸人條件下所對(duì)應(yīng)的的狀態(tài)圖次態(tài)。而在時(shí)序電路設(shè)計(jì)時(shí),狀態(tài)表已列出現(xiàn)態(tài)到次態(tài)的轉(zhuǎn)換關(guān)系,希望推導(dǎo)出觸發(fā)器的激勵(lì)條件。所以需將特性表做適當(dāng)變換,以給定的狀態(tài)轉(zhuǎn)換為條件,列出所需求的輸入信號(hào)。這樣的表格稱(chēng)為激勵(lì)表。根據(jù)表5.4.2建立的JK觸發(fā)器激勵(lì)表如表6.3,4所示。表中的×表示其邏輯值與該行的狀態(tài)轉(zhuǎn)換無(wú)關(guān)。

        

根據(jù)圖6.3,7和表6.3.4可以列出狀態(tài)轉(zhuǎn)換真值表及兩個(gè)觸發(fā)器所要求的激勵(lì)信號(hào),如表6,3,5所示c據(jù)此,分別畫(huà)出兩個(gè)觸發(fā)器的輸人J、Κ和電路輸出y的卡諾圖,如圖6,3.8所示。圖中,不使用的狀態(tài)均以無(wú)關(guān)項(xiàng)×填人。化簡(jiǎn)后得到激勵(lì)方程組和輸出方程

J1=Q0A   K1=A

J0=A      K0=A

y=Q1A

        

同步時(shí)序邏輯電路的設(shè)計(jì)里采取00→01→11→00的變化順序,可能會(huì)使其中的組合電路相對(duì)簡(jiǎn)單。于是,令c=00,a=01,c=11,得到狀態(tài)分配后的狀態(tài)圖,如圖6.3,7所示。

選擇觸發(fā)器類(lèi)型,用小規(guī)模集成的觸發(fā)器芯片設(shè)計(jì)時(shí)序電路時(shí),選用邏輯功能較強(qiáng)的JK觸發(fā)器可能得到較簡(jiǎn)化的組合電路。

確定激勵(lì)方程組和輸出方程組用JK觸發(fā)器設(shè)計(jì)時(shí)序電路時(shí),電路的激勵(lì).

        



SMD2920P300TF選擇觸發(fā)器類(lèi)型用小規(guī)模集成的觸發(fā)器芯片設(shè)計(jì)時(shí)序電路時(shí) ,選用邏輯功能較強(qiáng)的JK觸發(fā)器可能得到較簡(jiǎn)化的組合電路 。

確定激勵(lì)方程組和輸出方程組

用JK觸發(fā)器設(shè)計(jì)時(shí)序電路時(shí) ,電路的激勵(lì)方程需要間接導(dǎo)出。表5.4.2所示的JK觸發(fā)器特性表提供了在不同現(xiàn)態(tài)和輸人條件下所對(duì)應(yīng)的的狀態(tài)圖次態(tài)。而在時(shí)序電路設(shè)計(jì)時(shí),狀態(tài)表已列出現(xiàn)態(tài)到次態(tài)的轉(zhuǎn)換關(guān)系,希望推導(dǎo)出觸發(fā)器的激勵(lì)條件。所以需將特性表做適當(dāng)變換,以給定的狀態(tài)轉(zhuǎn)換為條件,列出所需求的輸入信號(hào)。這樣的表格稱(chēng)為激勵(lì)表。根據(jù)表5.4.2建立的JK觸發(fā)器激勵(lì)表如表6.3,4所示。表中的×表示其邏輯值與該行的狀態(tài)轉(zhuǎn)換無(wú)關(guān)。

        

根據(jù)圖6.3,7和表6.3.4可以列出狀態(tài)轉(zhuǎn)換真值表及兩個(gè)觸發(fā)器所要求的激勵(lì)信號(hào),如表6,3,5所示c據(jù)此,分別畫(huà)出兩個(gè)觸發(fā)器的輸人J、Κ和電路輸出y的卡諾圖,如圖6,3.8所示。圖中,不使用的狀態(tài)均以無(wú)關(guān)項(xiàng)×填人。化簡(jiǎn)后得到激勵(lì)方程組和輸出方程

J1=Q0A   K1=A

J0=A      K0=A

y=Q1A

        

同步時(shí)序邏輯電路的設(shè)計(jì)里采取00→01→11→00的變化順序,可能會(huì)使其中的組合電路相對(duì)簡(jiǎn)單。于是,令c=00,a=01,c=11,得到狀態(tài)分配后的狀態(tài)圖,如圖6.3,7所示。

選擇觸發(fā)器類(lèi)型,用小規(guī)模集成的觸發(fā)器芯片設(shè)計(jì)時(shí)序電路時(shí),選用邏輯功能較強(qiáng)的JK觸發(fā)器可能得到較簡(jiǎn)化的組合電路。

確定激勵(lì)方程組和輸出方程組用JK觸發(fā)器設(shè)計(jì)時(shí)序電路時(shí),電路的激勵(lì).

        



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