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CEVATM處理器SOC驗證降低ISA配置多種SDK維護(hù)成本

發(fā)布時間:2021/12/21 17:49:10 訪問次數(shù):237

StarFire-V340的新型FPGA原型驗證系統(tǒng),推動國內(nèi)原型驗證行業(yè)更上一個新的臺階。

該公司原有的StarFire系列主要針對各類型視音頻SOC的設(shè)計驗證,被國內(nèi)外設(shè)計公司廣泛采用累計達(dá)50多套。這款新的StarFire-V340系列繼承了StarFire系列的大部分優(yōu)點,在容量、靈活性和性能指標(biāo)方面有了進(jìn)一步提高,同時支持采用各類型ARMTM,TensilicaTM,CEVATM處理器的SOC驗證,從而適應(yīng)更廣泛的SOC/ASIC/IP的原型驗證和算法實現(xiàn)的要求。

StarFire-V340系列驗證板核心的FPGA芯片,存儲芯片以及速度要求較高的AD/DA芯片全部集成在母板上,以保證良好的信號速度和質(zhì)量。

在嵌入式處理器設(shè)計中,指令存儲器的大小可以決定成本的高低,因此Studio 9.1中代碼密度的提升功能將有助于降低系統(tǒng)整體成本。

Codasip的最新升級版本中包括了基于LLVM的SDK,其中有快速C/C++編譯器和Linker Support Package連接支持包,他們都于2021年4月在發(fā)布Studio 9.0版本時添加到該工具套件中。

在運行諸如GNU/Linux等更復(fù)雜操作系統(tǒng)的應(yīng)用處理器中,這項升級可以顯著改善對定制指令集的支持.另一項新功能為ISA子目標(biāo)提供了支持,從而大幅度降低了面向不同ISA配置的多種SDK的維護(hù)成本。

在AC/DC轉(zhuǎn)換器IC中仍然大范圍地使用產(chǎn)生大量損耗和熱量的DMOSFET和Planar MOSFET,即使表貼封裝產(chǎn)品也很難滿足幾十瓦級的輸出功率要求。

為解決這些問題,ROHM開發(fā)一種具有45W輸出功率的新產(chǎn)品,新產(chǎn)品已將低損耗SJ-MOSFET和優(yōu)化的控制電路集成在小型表貼封裝中。


此外,器件還具有單端或差分時鐘輸入,因而無需轉(zhuǎn)換時鐘信號;具有0.4V至1.4V較寬共模范圍的模擬輸入無需外部交流耦合電容即可配置為交流或直流耦合;片內(nèi)時鐘分頻器的使用則省去了外部分頻器。

(素材來源:eccn和21ic.如涉版權(quán)請聯(lián)系刪除。特別感謝)

StarFire-V340的新型FPGA原型驗證系統(tǒng),推動國內(nèi)原型驗證行業(yè)更上一個新的臺階。

該公司原有的StarFire系列主要針對各類型視音頻SOC的設(shè)計驗證,被國內(nèi)外設(shè)計公司廣泛采用累計達(dá)50多套。這款新的StarFire-V340系列繼承了StarFire系列的大部分優(yōu)點,在容量、靈活性和性能指標(biāo)方面有了進(jìn)一步提高,同時支持采用各類型ARMTM,TensilicaTM,CEVATM處理器的SOC驗證,從而適應(yīng)更廣泛的SOC/ASIC/IP的原型驗證和算法實現(xiàn)的要求。

StarFire-V340系列驗證板核心的FPGA芯片,存儲芯片以及速度要求較高的AD/DA芯片全部集成在母板上,以保證良好的信號速度和質(zhì)量。

在嵌入式處理器設(shè)計中,指令存儲器的大小可以決定成本的高低,因此Studio 9.1中代碼密度的提升功能將有助于降低系統(tǒng)整體成本。

Codasip的最新升級版本中包括了基于LLVM的SDK,其中有快速C/C++編譯器和Linker Support Package連接支持包,他們都于2021年4月在發(fā)布Studio 9.0版本時添加到該工具套件中。

在運行諸如GNU/Linux等更復(fù)雜操作系統(tǒng)的應(yīng)用處理器中,這項升級可以顯著改善對定制指令集的支持.另一項新功能為ISA子目標(biāo)提供了支持,從而大幅度降低了面向不同ISA配置的多種SDK的維護(hù)成本。

在AC/DC轉(zhuǎn)換器IC中仍然大范圍地使用產(chǎn)生大量損耗和熱量的DMOSFET和Planar MOSFET,即使表貼封裝產(chǎn)品也很難滿足幾十瓦級的輸出功率要求。

為解決這些問題,ROHM開發(fā)一種具有45W輸出功率的新產(chǎn)品,新產(chǎn)品已將低損耗SJ-MOSFET和優(yōu)化的控制電路集成在小型表貼封裝中。


此外,器件還具有單端或差分時鐘輸入,因而無需轉(zhuǎn)換時鐘信號;具有0.4V至1.4V較寬共模范圍的模擬輸入無需外部交流耦合電容即可配置為交流或直流耦合;片內(nèi)時鐘分頻器的使用則省去了外部分頻器。

(素材來源:eccn和21ic.如涉版權(quán)請聯(lián)系刪除。特別感謝)

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