集成式端接5×5mm和6×6mm封裝可使電路板面積減小90%
發(fā)布時間:2023/8/13 11:12:14 訪問次數(shù):93
3.3V器件與1.5V 9FGU系列和1.8V 9FGV系列PCIe時鐘發(fā)生器引腳兼容。
這些時序系列產(chǎn)品面向功耗和空間受限的消費(fèi)類產(chǎn)品和其他高性能應(yīng)用,可提供企業(yè)級應(yīng)用性能,同時降低總體擁有成本。這些產(chǎn)品的潛在應(yīng)用包括多功能打印機(jī)、服務(wù)器、機(jī)頂盒和固態(tài)硬盤等。整個產(chǎn)品系列與PCIe Gen1, Gen2和Gen3的時鐘規(guī)范兼容。
工廠可編程版本,允許用戶自定義默認(rèn)配置,包括輸出阻抗、控制輸入極性、內(nèi)部上拉或下拉電阻、以及針對晶體振蕩器網(wǎng)路喚醒模式。這省去了幾乎所有的外部粘合邏輯。
工廠可編程版本能使器件得到快速優(yōu)化,以滿足客戶的具體要求。該SoC-friendly 型器件大大超過了PCIe Gen3規(guī)范對于相位抖動的要求,并可滿足未來的PCIe Gen4規(guī)范,非常適用于千兆以太網(wǎng)和其它RMS Jitter(12K-20Mhz)小于3ps高性能應(yīng)用。
將相同的功能放進(jìn)智能手表時,9 Degrees Freedom的Qlipp的加速度計和陀螺儀要比普通智能手表所使用的更加先進(jìn),而智能手表也無法分辨出正手和反手揮拍。
3.3V版的低功耗PCIe緩沖器及多路復(fù)用器,這些將與市場成功的9DBU/V和9DMU/V系列引腳兼容。
9FGL PCIe時鐘發(fā)生器系列包括具有2、4、6、或8路輸出的器件。時鐘發(fā)生器支持有或無擴(kuò)頻的PCIe共同時鐘架構(gòu),以及PCIe獨(dú)立參考時鐘結(jié)構(gòu)。這些器件能夠提供參考時鐘的副本,在設(shè)計中可以節(jié)省一個晶體。
3.3V(L系列)系列具有多個業(yè)界第一,輸出阻抗通過輸出到輸出配置,允許一個器件應(yīng)用于混合阻抗環(huán)境,而無需采用外部端接元件。
深圳市慈安科技有限公司http://cakj.51dzw.com
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工廠可編程版本,允許用戶自定義默認(rèn)配置,包括輸出阻抗、控制輸入極性、內(nèi)部上拉或下拉電阻、以及針對晶體振蕩器網(wǎng)路喚醒模式。這省去了幾乎所有的外部粘合邏輯。
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9FGL PCIe時鐘發(fā)生器系列包括具有2、4、6、或8路輸出的器件。時鐘發(fā)生器支持有或無擴(kuò)頻的PCIe共同時鐘架構(gòu),以及PCIe獨(dú)立參考時鐘結(jié)構(gòu)。這些器件能夠提供參考時鐘的副本,在設(shè)計中可以節(jié)省一個晶體。
3.3V(L系列)系列具有多個業(yè)界第一,輸出阻抗通過輸出到輸出配置,允許一個器件應(yīng)用于混合阻抗環(huán)境,而無需采用外部端接元件。
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