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PCI總線接口技術及其在高速數(shù)據(jù)采集系統(tǒng)中的應用

發(fā)布時間:2008/5/26 0:00:00 訪問次數(shù):666

作者:北京理工大學電子工程系(100081)譚博釗 徐元軍 單 濤 陶 然

來源:《電子技術應用》

摘要:一種基于pci總線的高速數(shù)據(jù)采集傳輸系統(tǒng)的實現(xiàn),討論了pci總線控制器9054的性能及三種傳輸模式,提供了該系統(tǒng)的硬件實現(xiàn)和采用dma傳輸方式實現(xiàn)數(shù)據(jù)傳輸?shù)脑O計。 關鍵詞:pci總線 pci 9054總線控制器 dma 數(shù)據(jù)采集是數(shù)字信號處理中非常重要的環(huán)節(jié)。對于不同的任務,數(shù)據(jù)采集要達到的技術指標也不相同。對于瞬態(tài)信號,雷達信號和圖像處理都需要幾mb/s甚至幾十mb/s的超高速采集速率。目前用于pc機的數(shù)據(jù)采集卡大部分是基于isa總線的,這種結構的最大缺點是傳輸速率太低,不能實現(xiàn)數(shù)據(jù)的實現(xiàn)高速傳輸。pci總線推出后,以其突出的性能備受計算機和通信業(yè)界的青睞,將取代以往的總線, 成為高檔機及高性能工作站外部件的基石。pci作為局部總線,一邊與處理器和存儲器總線接口;另一邊為外設擴展提供了高速通道。33mhz、32位的pci總線可以實現(xiàn)132mb/s的數(shù)據(jù)傳輸速率;64位的pci總線性能加倍。開發(fā)以pci總線為基礎的數(shù)據(jù)采集設備是技術發(fā)展的必然要求。在實際工作中,利用pci總線將采集數(shù)據(jù)直接傳到系統(tǒng)內存,可有效解決數(shù)據(jù)的實時傳輸和存儲,為信號的實時處理提供方便。 1 數(shù)據(jù)采集系統(tǒng)的結構與功能 本數(shù)據(jù)采集系統(tǒng)應用于雷達視頻回波信號的處理。信號由兩路正交視頻回波信號組成,故采用雙通道。采集指標:2路采集信號,采樣率為40m個樣本,a/d采樣字長是10位。每路數(shù)字信號字長取16位,兩路合成路共32位,將32位數(shù)據(jù)分別傳入系統(tǒng)內存的不同區(qū)域,以便后續(xù)處理。系統(tǒng)設計以pci總線控制器為基礎,通過dma方式分別將32位數(shù)據(jù)傳輸系統(tǒng)內存的不同區(qū)域。主要功能模塊有:pci總線控制器、雙口sram、采集控制芯片epld、a/d部分。系統(tǒng)框圖如圖1所示。 2 pci總線控制器的實現(xiàn) pci總線是一個地址/數(shù)據(jù)、命令/字節(jié)選擇信號復用的總線。它采用主從信號雙向握手的方式來控制數(shù)據(jù)的傳輸,其接口電路設計與傳統(tǒng)總線接口電路設計沒有大的區(qū)別。一般來說,一個pci接口電路應當完成以下幾種功能:(1)地址譯碼及命令譯碼,由于pci總線可以采用正向方式和負向方式進行譯碼。因此用戶應視應用情況選擇適當?shù)淖g碼方式。一般選擇正向譯碼;為保證不會出現(xiàn)地址沖突,最好采用全地址譯碼;命令信號線c/be[0~3]必須能加譯碼。(2)地址產生電路。pci的突發(fā)傳輸方式包括一個地址周期和若干個數(shù)據(jù)周期,因此在pci接口電路中必須包含高速的地址產生部件,用于向后級應用電路提供連接的地址。(3)控制信號的產生。pci總線上的數(shù)據(jù)傳輸基本上由frame、irdy、trdy和debvsel 4根信號線控制,因此必須根據(jù)主從設備的忙閑情況相應產生這些控制信號。另外,pci接口電路還應完成地址鎖存及數(shù)據(jù)分離、命令鎖存及字節(jié)選擇信號分離的功能。值得注意的是:在設計這個功能時必須考慮到pci規(guī)范中信號的負載能力。實現(xiàn)pci總線控制器大體有兩種方式:使用可編程器件和專用接口芯片。采用epld和fpga等編程邏輯器件的優(yōu)點在于其靈活的可編程性。專用芯片可以實現(xiàn)完整的pci主控模塊和目標模塊接口功能,將復雜的pci總線接口轉換為相對簡單的接口。用戶可以集中精力于應用設計,而不是調試pci總線的接口,明顯縮短了開發(fā)時間。本設計應用plx公司的pci9054實現(xiàn)總線控制器。 3 pci 9054簡介 pci 9054是32位/33mhz的通用pci總線控制器專用芯片。該芯片符合pci總線規(guī)范2.2版,突發(fā)傳輸速率達到132mb/s。局部總線支持復用/非復用的32位地址/數(shù)據(jù),可為m模式、c模式、j模式中的一種。pci 9054內部有6種可編程的fifo,以實現(xiàn)零等待突發(fā)傳輸及局部總線和pci總線之間的異步操作。9054支持主模式、從模式、dma

作者:北京理工大學電子工程系(100081)譚博釗 徐元軍 單 濤 陶 然

來源:《電子技術應用》

摘要:一種基于pci總線的高速數(shù)據(jù)采集傳輸系統(tǒng)的實現(xiàn),討論了pci總線控制器9054的性能及三種傳輸模式,提供了該系統(tǒng)的硬件實現(xiàn)和采用dma傳輸方式實現(xiàn)數(shù)據(jù)傳輸?shù)脑O計。 關鍵詞:pci總線 pci 9054總線控制器 dma 數(shù)據(jù)采集是數(shù)字信號處理中非常重要的環(huán)節(jié)。對于不同的任務,數(shù)據(jù)采集要達到的技術指標也不相同。對于瞬態(tài)信號,雷達信號和圖像處理都需要幾mb/s甚至幾十mb/s的超高速采集速率。目前用于pc機的數(shù)據(jù)采集卡大部分是基于isa總線的,這種結構的最大缺點是傳輸速率太低,不能實現(xiàn)數(shù)據(jù)的實現(xiàn)高速傳輸。pci總線推出后,以其突出的性能備受計算機和通信業(yè)界的青睞,將取代以往的總線, 成為高檔機及高性能工作站外部件的基石。pci作為局部總線,一邊與處理器和存儲器總線接口;另一邊為外設擴展提供了高速通道。33mhz、32位的pci總線可以實現(xiàn)132mb/s的數(shù)據(jù)傳輸速率;64位的pci總線性能加倍。開發(fā)以pci總線為基礎的數(shù)據(jù)采集設備是技術發(fā)展的必然要求。在實際工作中,利用pci總線將采集數(shù)據(jù)直接傳到系統(tǒng)內存,可有效解決數(shù)據(jù)的實時傳輸和存儲,為信號的實時處理提供方便。 1 數(shù)據(jù)采集系統(tǒng)的結構與功能 本數(shù)據(jù)采集系統(tǒng)應用于雷達視頻回波信號的處理。信號由兩路正交視頻回波信號組成,故采用雙通道。采集指標:2路采集信號,采樣率為40m個樣本,a/d采樣字長是10位。每路數(shù)字信號字長取16位,兩路合成路共32位,將32位數(shù)據(jù)分別傳入系統(tǒng)內存的不同區(qū)域,以便后續(xù)處理。系統(tǒng)設計以pci總線控制器為基礎,通過dma方式分別將32位數(shù)據(jù)傳輸系統(tǒng)內存的不同區(qū)域。主要功能模塊有:pci總線控制器、雙口sram、采集控制芯片epld、a/d部分。系統(tǒng)框圖如圖1所示。 2 pci總線控制器的實現(xiàn) pci總線是一個地址/數(shù)據(jù)、命令/字節(jié)選擇信號復用的總線。它采用主從信號雙向握手的方式來控制數(shù)據(jù)的傳輸,其接口電路設計與傳統(tǒng)總線接口電路設計沒有大的區(qū)別。一般來說,一個pci接口電路應當完成以下幾種功能:(1)地址譯碼及命令譯碼,由于pci總線可以采用正向方式和負向方式進行譯碼。因此用戶應視應用情況選擇適當?shù)淖g碼方式。一般選擇正向譯碼;為保證不會出現(xiàn)地址沖突,最好采用全地址譯碼;命令信號線c/be[0~3]必須能加譯碼。(2)地址產生電路。pci的突發(fā)傳輸方式包括一個地址周期和若干個數(shù)據(jù)周期,因此在pci接口電路中必須包含高速的地址產生部件,用于向后級應用電路提供連接的地址。(3)控制信號的產生。pci總線上的數(shù)據(jù)傳輸基本上由frame、irdy、trdy和debvsel 4根信號線控制,因此必須根據(jù)主從設備的忙閑情況相應產生這些控制信號。另外,pci接口電路還應完成地址鎖存及數(shù)據(jù)分離、命令鎖存及字節(jié)選擇信號分離的功能。值得注意的是:在設計這個功能時必須考慮到pci規(guī)范中信號的負載能力。實現(xiàn)pci總線控制器大體有兩種方式:使用可編程器件和專用接口芯片。采用epld和fpga等編程邏輯器件的優(yōu)點在于其靈活的可編程性。專用芯片可以實現(xiàn)完整的pci主控模塊和目標模塊接口功能,將復雜的pci總線接口轉換為相對簡單的接口。用戶可以集中精力于應用設計,而不是調試pci總線的接口,明顯縮短了開發(fā)時間。本設計應用plx公司的pci9054實現(xiàn)總線控制器。 3 pci 9054簡介 pci 9054是32位/33mhz的通用pci總線控制器專用芯片。該芯片符合pci總線規(guī)范2.2版,突發(fā)傳輸速率達到132mb/s。局部總線支持復用/非復用的32位地址/數(shù)據(jù),可為m模式、c模式、j模式中的一種。pci 9054內部有6種可編程的fifo,以實現(xiàn)零等待突發(fā)傳輸及局部總線和pci總線之間的異步操作。9054支持主模式、從模式、dma

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