二極管或門電路
發(fā)布時間:2012/1/6 11:02:58 訪問次數(shù):7056
1.或門電路圖形符號
圖11-64(a)所示為過去規(guī)定的或門電路的電路圖形符號,方框中用+號表示是或邏輯。圖11-64(b)所示最新規(guī)定的或門電路圖形符號,注意新規(guī)定中的符號與舊符號不同。
2.二極管或門電路
圖11-65所示是二極管構(gòu)成的或門電路,H232ACB 這里的或門電路共有3個輸入么、B、C,輸出是Fo分析或門電路工作原理要將或門電路的輸入分成下列幾種情況。
(1)設(shè)4、曰、C3個輸入均為邏輯0(邏輯0為低電平,簡稱0,此0不是算術(shù)中的0),此時VD1、VD2和VD3正極電壓全吝B為低電平,這樣3只二極管全部導(dǎo)通,此時輸出F通過電阻R1與電源-V相連,這樣輸出F輸出低電平,即F輸出0。
(2)設(shè)只有輸入A為高電平1(此為邏輯1,簡稱1,不是算術(shù)中1),設(shè)這一高電平的電壓為+3V,B、C輸入仍為0,由于A為1,+3V電壓加到VD1正極,使VD1導(dǎo)通,VD1導(dǎo)通后其負(fù)極也為+3V(不計VD1導(dǎo)通后管壓降),使或門電路輸出F為+3V,為高電平(即為1)。此時,由于VD2、VD3正極為0,而負(fù)極為1(VD1導(dǎo)通后使F為1),所以VD2、VD3因反向偏置電壓而處于截止?fàn)顟B(tài)。
(3)設(shè)輸入有兩個同時為1,但有一個輸入仍然為0時,同樣的道理或門電路的輸出F輸出1。
(4)設(shè)3個輸入4、B、C同時為1,VD1、VD2、VD3均導(dǎo)通,或門電路輸出F也為l。
3.或邏輯真值表
或門電路的輸八與輸出之間的邏輯關(guān)系為或邏輯,或邏輯可以用真值表來表示各輸入與輸出之間的邏輯關(guān)系,有3個輸入的或門電路真值表見表11-6。
1.或門電路圖形符號
圖11-64(a)所示為過去規(guī)定的或門電路的電路圖形符號,方框中用+號表示是或邏輯。圖11-64(b)所示最新規(guī)定的或門電路圖形符號,注意新規(guī)定中的符號與舊符號不同。
2.二極管或門電路
圖11-65所示是二極管構(gòu)成的或門電路,H232ACB 這里的或門電路共有3個輸入么、B、C,輸出是Fo分析或門電路工作原理要將或門電路的輸入分成下列幾種情況。
(1)設(shè)4、曰、C3個輸入均為邏輯0(邏輯0為低電平,簡稱0,此0不是算術(shù)中的0),此時VD1、VD2和VD3正極電壓全吝B為低電平,這樣3只二極管全部導(dǎo)通,此時輸出F通過電阻R1與電源-V相連,這樣輸出F輸出低電平,即F輸出0。
(2)設(shè)只有輸入A為高電平1(此為邏輯1,簡稱1,不是算術(shù)中1),設(shè)這一高電平的電壓為+3V,B、C輸入仍為0,由于A為1,+3V電壓加到VD1正極,使VD1導(dǎo)通,VD1導(dǎo)通后其負(fù)極也為+3V(不計VD1導(dǎo)通后管壓降),使或門電路輸出F為+3V,為高電平(即為1)。此時,由于VD2、VD3正極為0,而負(fù)極為1(VD1導(dǎo)通后使F為1),所以VD2、VD3因反向偏置電壓而處于截止?fàn)顟B(tài)。
(3)設(shè)輸入有兩個同時為1,但有一個輸入仍然為0時,同樣的道理或門電路的輸出F輸出1。
(4)設(shè)3個輸入4、B、C同時為1,VD1、VD2、VD3均導(dǎo)通,或門電路輸出F也為l。
3.或邏輯真值表
或門電路的輸八與輸出之間的邏輯關(guān)系為或邏輯,或邏輯可以用真值表來表示各輸入與輸出之間的邏輯關(guān)系,有3個輸入的或門電路真值表見表11-6。
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