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表決電路原理

發(fā)布時(shí)間:2014/1/27 11:17:48 訪問(wèn)次數(shù):1706

     由卡諾圖得出邏輯表D2431P達(dá)式,并演化成“與非”的形式為

                               

      最后,畫(huà)出用“與非門(mén)”構(gòu)成的邏輯電路如圖3. 71所示。

      

      輸入端接至邏輯開(kāi)關(guān)(撥位開(kāi)關(guān))輸出插口,輸出端接邏輯電平顯示端口,自擬真值表,逐次改變輸入變量,驗(yàn)證邏輯功能。

      ②試用10線一4線優(yōu)先編碼器74LS147(相關(guān)資料見(jiàn)實(shí)驗(yàn)六)和基本門(mén)電路構(gòu)成輸出為8421BCD碼并具有編碼輸出標(biāo)志的編碼器。

      邏輯圖為:

      如圖3.72所示為輸出為8421BCD碼并具有編碼輸出標(biāo)志的編碼器的邏輯圖。       



  

     由卡諾圖得出邏輯表D2431P達(dá)式,并演化成“與非”的形式為

                               

      最后,畫(huà)出用“與非門(mén)”構(gòu)成的邏輯電路如圖3. 71所示。

      

      輸入端接至邏輯開(kāi)關(guān)(撥位開(kāi)關(guān))輸出插口,輸出端接邏輯電平顯示端口,自擬真值表,逐次改變輸入變量,驗(yàn)證邏輯功能。

      ②試用10線一4線優(yōu)先編碼器74LS147(相關(guān)資料見(jiàn)實(shí)驗(yàn)六)和基本門(mén)電路構(gòu)成輸出為8421BCD碼并具有編碼輸出標(biāo)志的編碼器。

      邏輯圖為:

      如圖3.72所示為輸出為8421BCD碼并具有編碼輸出標(biāo)志的編碼器的邏輯圖。       



  

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