四2輸入與非門
發(fā)布時(shí)間:2014/1/27 11:24:10 訪問次數(shù):12108
實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟,完成組EEVHB1E330P合邏輯電路的設(shè)計(jì)中的兩個(gè)例子。設(shè)計(jì)一個(gè)四人無(wú)棄權(quán)表決電路(多數(shù)贊成則提議通過(guò)),要求用四2輸入與非門來(lái)實(shí)現(xiàn),真值表填入表3. 62。
設(shè)計(jì)一個(gè)保險(xiǎn)箱用的4位數(shù)字代碼鎖,該鎖有規(guī)定的地址代碼A、B、C、D四個(gè)輸入端和一個(gè)開箱鑰匙孔信號(hào)E的輸入端,鎖的代碼由實(shí)驗(yàn)者自編。當(dāng)用鑰匙開箱時(shí),如果輸入代碼正確,保險(xiǎn)箱被打開;如果輸入代碼錯(cuò)誤,電路將發(fā)出警報(bào)。要求用最少的與非門實(shí)現(xiàn)。
用與非門74LSOO和異或門74LS86設(shè)計(jì)一可逆的4位碼變換器。
實(shí)際報(bào)告要求,當(dāng)控制信號(hào)C=l時(shí),它將8421碼轉(zhuǎn)換成為格雷碼;當(dāng)控制信號(hào)C=O時(shí),它將格雷碼轉(zhuǎn)換成為8421碼。
寫出設(shè)計(jì)步驟,列出碼變換關(guān)系真值表并畫出邏輯電路圖。
安裝電路并測(cè)試邏輯電路的功能。
復(fù)習(xí)各種基本門電路的使用方法。
實(shí)驗(yàn)前,畫好實(shí)驗(yàn)用的電路圖和表格。
自己參考有關(guān)資料畫出實(shí)驗(yàn)內(nèi)容②、③、④中的原理圖,找出實(shí)驗(yàn)將要使用的芯片,以備實(shí)驗(yàn)時(shí)用。
實(shí)驗(yàn)報(bào)告要求,將實(shí)驗(yàn)結(jié)果填人自制的表格中,驗(yàn)證設(shè)計(jì)是否正確。總結(jié)組含邏輯電路的分析與設(shè)計(jì)方法。
實(shí)驗(yàn)原始數(shù)據(jù)記錄
步驟1:設(shè)計(jì)一個(gè)4人無(wú)棄權(quán)表決電路(多數(shù)贊成則提議通過(guò)),要求用四2輸入與非門來(lái)實(shí)現(xiàn)。填寫表3. 62,并寫出邏輯函數(shù)式。
邏輯函數(shù)式:
步驟2:根據(jù)“(5)實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟”中的③,自行設(shè)計(jì)表格,填寫真值表,寫出邏輯函數(shù)式。
步驟3:根據(jù)“⑤實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟”中的④,自行設(shè)計(jì)表格,填寫真值表,寫出邏輯函數(shù)式。
實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟,完成組EEVHB1E330P合邏輯電路的設(shè)計(jì)中的兩個(gè)例子。設(shè)計(jì)一個(gè)四人無(wú)棄權(quán)表決電路(多數(shù)贊成則提議通過(guò)),要求用四2輸入與非門來(lái)實(shí)現(xiàn),真值表填入表3. 62。
設(shè)計(jì)一個(gè)保險(xiǎn)箱用的4位數(shù)字代碼鎖,該鎖有規(guī)定的地址代碼A、B、C、D四個(gè)輸入端和一個(gè)開箱鑰匙孔信號(hào)E的輸入端,鎖的代碼由實(shí)驗(yàn)者自編。當(dāng)用鑰匙開箱時(shí),如果輸入代碼正確,保險(xiǎn)箱被打開;如果輸入代碼錯(cuò)誤,電路將發(fā)出警報(bào)。要求用最少的與非門實(shí)現(xiàn)。
用與非門74LSOO和異或門74LS86設(shè)計(jì)一可逆的4位碼變換器。
實(shí)際報(bào)告要求,當(dāng)控制信號(hào)C=l時(shí),它將8421碼轉(zhuǎn)換成為格雷碼;當(dāng)控制信號(hào)C=O時(shí),它將格雷碼轉(zhuǎn)換成為8421碼。
寫出設(shè)計(jì)步驟,列出碼變換關(guān)系真值表并畫出邏輯電路圖。
安裝電路并測(cè)試邏輯電路的功能。
復(fù)習(xí)各種基本門電路的使用方法。
實(shí)驗(yàn)前,畫好實(shí)驗(yàn)用的電路圖和表格。
自己參考有關(guān)資料畫出實(shí)驗(yàn)內(nèi)容②、③、④中的原理圖,找出實(shí)驗(yàn)將要使用的芯片,以備實(shí)驗(yàn)時(shí)用。
實(shí)驗(yàn)報(bào)告要求,將實(shí)驗(yàn)結(jié)果填人自制的表格中,驗(yàn)證設(shè)計(jì)是否正確。總結(jié)組含邏輯電路的分析與設(shè)計(jì)方法。
實(shí)驗(yàn)原始數(shù)據(jù)記錄
步驟1:設(shè)計(jì)一個(gè)4人無(wú)棄權(quán)表決電路(多數(shù)贊成則提議通過(guò)),要求用四2輸入與非門來(lái)實(shí)現(xiàn)。填寫表3. 62,并寫出邏輯函數(shù)式。
邏輯函數(shù)式:
步驟2:根據(jù)“(5)實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟”中的③,自行設(shè)計(jì)表格,填寫真值表,寫出邏輯函數(shù)式。
步驟3:根據(jù)“⑤實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)步驟”中的④,自行設(shè)計(jì)表格,填寫真值表,寫出邏輯函數(shù)式。
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