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由74LS138構(gòu)成的1~8數(shù)據(jù)分配器

發(fā)布時(shí)間:2014/7/12 13:39:52 訪問次數(shù):15208

   用74LS153或74LS138可以實(shí)現(xiàn)很多組合電路的邏輯功能,例如用XC2164A51TMR2片74LS153可以設(shè)計(jì)8選1數(shù)據(jù)選擇器,用4片74LS153可以設(shè)計(jì)成16選1數(shù)據(jù)選擇器;用2片74LS138可以設(shè)計(jì)成4-16譯碼器;用4片74LS138可以設(shè)計(jì)成5-32譯碼器;用1片74LS138和1片74LS153可以設(shè)計(jì)總線傳輸結(jié)構(gòu)電路。

   用MSI組合功能件設(shè)計(jì)組合電路,不一定要嚴(yán)格按照組合電路的設(shè)計(jì)步驟,從列出真值表開始一步一步地進(jìn)行,只要設(shè)計(jì)者對(duì)所實(shí)現(xiàn)的邏輯功能和所用器件的邏輯功能很清楚,有時(shí)可以直接用所給器件設(shè)計(jì)出電路圖,即一步到位畫出電路圖。例如,用1片74LS138可以設(shè)計(jì)成1~8數(shù)據(jù)分配器,如圖3. 17所示,以A:A,A。作為地址,有兩個(gè)方案,方案一是以SA作為數(shù)據(jù)輸入端,方案二是以S。和S。作為數(shù)據(jù)輸入端,在地址A2A,Ao為000、001、

…、111時(shí),輸入數(shù)據(jù)D依次分配到輸出端y!瓂,或OUT!璒UT7。

       

   十進(jìn)制譯碼器

   二一十進(jìn)制譯碼器的邏輯功能是將輸入的BCD碼的10個(gè)代碼譯成10個(gè)高、低電平輸出信號(hào)。輸入BCD碼(0000--- ---1001),輸出的10個(gè)信號(hào)分別與十進(jìn)制數(shù)的10個(gè)數(shù)字相對(duì)應(yīng),其示意圖如圖3. 18所示。二一十進(jìn)制譯碼器74LS42(又稱4線-10線譯碼器,其引腳如圖3. 19所示)的真值表如表3.7所示。


   用74LS153或74LS138可以實(shí)現(xiàn)很多組合電路的邏輯功能,例如用XC2164A51TMR2片74LS153可以設(shè)計(jì)8選1數(shù)據(jù)選擇器,用4片74LS153可以設(shè)計(jì)成16選1數(shù)據(jù)選擇器;用2片74LS138可以設(shè)計(jì)成4-16譯碼器;用4片74LS138可以設(shè)計(jì)成5-32譯碼器;用1片74LS138和1片74LS153可以設(shè)計(jì)總線傳輸結(jié)構(gòu)電路。

   用MSI組合功能件設(shè)計(jì)組合電路,不一定要嚴(yán)格按照組合電路的設(shè)計(jì)步驟,從列出真值表開始一步一步地進(jìn)行,只要設(shè)計(jì)者對(duì)所實(shí)現(xiàn)的邏輯功能和所用器件的邏輯功能很清楚,有時(shí)可以直接用所給器件設(shè)計(jì)出電路圖,即一步到位畫出電路圖。例如,用1片74LS138可以設(shè)計(jì)成1~8數(shù)據(jù)分配器,如圖3. 17所示,以A:A,A。作為地址,有兩個(gè)方案,方案一是以SA作為數(shù)據(jù)輸入端,方案二是以S。和S。作為數(shù)據(jù)輸入端,在地址A2A,Ao為000、001、

…、111時(shí),輸入數(shù)據(jù)D依次分配到輸出端y。……y,或OUT。……OUT7。

       

   十進(jìn)制譯碼器

   二一十進(jìn)制譯碼器的邏輯功能是將輸入的BCD碼的10個(gè)代碼譯成10個(gè)高、低電平輸出信號(hào)。輸入BCD碼(0000--- ---1001),輸出的10個(gè)信號(hào)分別與十進(jìn)制數(shù)的10個(gè)數(shù)字相對(duì)應(yīng),其示意圖如圖3. 18所示。二一十進(jìn)制譯碼器74LS42(又稱4線-10線譯碼器,其引腳如圖3. 19所示)的真值表如表3.7所示。


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相關(guān)技術(shù)資料
7-12由74LS138構(gòu)成的1~8數(shù)據(jù)分配器
相關(guān)IC型號(hào)
XC2164A51TMR
XC2141C21AMR
XC2151A500MR

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