VHDL語言簡(jiǎn)介
發(fā)布時(shí)間:2015/8/26 20:14:35 訪問次數(shù):408
VHDL(VHSIC Hardware Description Language)是在20世紀(jì)七八寸一年代由美國(guó)國(guó)防部資助的VHSIC項(xiàng)目開發(fā)的產(chǎn)品。在這個(gè)語言首次開發(fā)出來時(shí),D-128-0028其目標(biāo)僅是一個(gè)使電路文本化的一種標(biāo)準(zhǔn),使人們采用文本方式描述的設(shè)計(jì)能夠被其他人所理解。VHDL于1987年由IEEE 1076標(biāo)準(zhǔn)所確認(rèn),1993年IEEE 1076標(biāo)準(zhǔn)被升級(jí)、更新,新的VHDL標(biāo)準(zhǔn)為IEEE1164,1996年IEEE 1076.3成為VHDL綜合標(biāo)準(zhǔn),F(xiàn)在,VHDL已成為一個(gè)數(shù)字電路和系統(tǒng)的描述、建模、綜合的工業(yè)標(biāo)準(zhǔn),在電子產(chǎn)業(yè)界,無論是ASIC設(shè)計(jì)人員,還是系統(tǒng)級(jí)設(shè)計(jì)人員,都需要學(xué)習(xí)VHDL來提高他們的工作效率。利用VHDL及自頂向下設(shè)計(jì)方法在大型數(shù)寧系統(tǒng)設(shè)計(jì)中被廣泛采用,在設(shè)計(jì)中可采用較抽象的語言來描述系統(tǒng)結(jié)構(gòu),然后細(xì)化成各模塊,最后借助編譯器將VHDL描述綜合為門級(jí)。
VHDL(VHSIC Hardware Description Language)是在20世紀(jì)七八寸一年代由美國(guó)國(guó)防部資助的VHSIC項(xiàng)目開發(fā)的產(chǎn)品。在這個(gè)語言首次開發(fā)出來時(shí),D-128-0028其目標(biāo)僅是一個(gè)使電路文本化的一種標(biāo)準(zhǔn),使人們采用文本方式描述的設(shè)計(jì)能夠被其他人所理解。VHDL于1987年由IEEE 1076標(biāo)準(zhǔn)所確認(rèn),1993年IEEE 1076標(biāo)準(zhǔn)被升級(jí)、更新,新的VHDL標(biāo)準(zhǔn)為IEEE1164,1996年IEEE 1076.3成為VHDL綜合標(biāo)準(zhǔn)。現(xiàn)在,VHDL已成為一個(gè)數(shù)字電路和系統(tǒng)的描述、建模、綜合的工業(yè)標(biāo)準(zhǔn),在電子產(chǎn)業(yè)界,無論是ASIC設(shè)計(jì)人員,還是系統(tǒng)級(jí)設(shè)計(jì)人員,都需要學(xué)習(xí)VHDL來提高他們的工作效率。利用VHDL及自頂向下設(shè)計(jì)方法在大型數(shù)寧系統(tǒng)設(shè)計(jì)中被廣泛采用,在設(shè)計(jì)中可采用較抽象的語言來描述系統(tǒng)結(jié)構(gòu),然后細(xì)化成各模塊,最后借助編譯器將VHDL描述綜合為門級(jí)。
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