優(yōu)勢和特點(diǎn)

產(chǎn)品詳情

靈活的可重新配置無線電通用平臺設(shè)計

4D2A（4 × 3 GSPS 至 12 GSPS DAC 和 2 × 3 GSPS 至 6 GSPS ADC）

4D1A（4 × 3 GSPS 至 12 GSPS DAC 和 1 × 3 GSPS 至 6 GSPS ADC）

5.2 GHz 和 7.5 GHz 的 RF DAC/RF ADC 輸出/輸入 −3 dB 帶寬

高達(dá) 1.6 GHz/3 GHz 的發(fā)射/接收通道帶寬 (4T2R)

高達(dá) 2.4 GHz/3 GHz 的發(fā)射/接收通道帶寬 (2T2R)

具有多芯片同步功能的片內(nèi) PLL（6 GHz 至 12 GHz）；提供輸出時鐘

外部 RFCLK 輸入選項

AC 性能目標(biāo)

ADC 測試條件（6 GSPS，−1 dBFS，fIN < 1.4 GHz）

NSD = −154 dBFS/Hz；HD2 < −70 dBc；HD3 < −70 dBc；SFDR（不包括 HD2、HD3）<−78 dBc；IL < −75 dBc

DAC 測試條件（6 GSPS，−7 dBFS，1.8 GHz）

NSD = −158 dBFS/Hz；SFDR < −74 dBc

通用數(shù)字特性

支持實(shí)數(shù)或復(fù)數(shù)數(shù)字?jǐn)?shù)據(jù)（8、12 或 16 位）

可配置 DDC/DUC

8 個細(xì)調(diào)復(fù)數(shù) DUC 和 4 個粗調(diào)復(fù)數(shù) DUC

8 個細(xì)調(diào)復(fù)數(shù) DDC 和 4 個粗調(diào)復(fù)數(shù) DDC

每個 DUC/DDC 具有 2 個獨(dú)立的 NCO

可選擇旁路細(xì)調(diào)和粗調(diào) DUC/DDC

可編程 192 抽頭 FIR 濾波器

RxAGC 支持

用于快速 AGC 控制、具有低延遲的快速檢測

用于緩慢 AGC 控制的信號監(jiān)控器

專用 AGC 支持引腳

發(fā)射 DPD 支持

細(xì)調(diào) DUC 通道增益控制和延遲調(diào)整

ADC 觀察路徑的粗調(diào) DDC 延遲調(diào)整

輔助特性

快速跳頻

低延遲數(shù)字回環(huán)模式（ADC 到 DAC）

具有可選分頻比的 ADC 時鐘驅(qū)動器

PA 下游保護(hù)電路

片內(nèi)溫度傳感器

靈活的 GPIO 引腳

具有可選分頻比的 ADC 時鐘驅(qū)動器

功率放大器下游保護(hù)電路

片內(nèi)溫度傳感器

可編程 GPIO 引腳

TDD 節(jié)能選項

SERDES JESD204B/JESD204C 接口，16 個通道，速率高達(dá) 24.75 Gbps

8 個用于 RF DAC 的接收通道

8 個用于 RF AD 的發(fā)射通道

與最大 15.5 Gbps 的通道速率兼容的 204B

與最大 24.75 Gbps 的通道速率兼容的 204C

與最大 24.75 Gbps 的通道速率兼容的 204C

用于接收通道速率匹配的采樣/位重復(fù)模式

目標(biāo)通常約為 6 W 至 7 W

具有 0.8 mm 間距的 15 mm × 15 mm BGA

ADS9-V2EBZ

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當(dāng)連接到指定的 ADI 公司高速轉(zhuǎn)換器評估板時，ADS9-V2EBZ 可作為數(shù)據(jù)采集/發(fā)射板。ADS9-V2EBZ 上的 FPGA 旨在支持最高速度的 JESD204B/C 數(shù)據(jù)轉(zhuǎn)換器，可用作高速 ADC 的數(shù)據(jù)接收器，也可用作高速 DAC 的發(fā)射器。

優(yōu)勢和特點(diǎn)

Xilinx Kintex Ultrascale+ XCKU15P-2FFVE1517E FPGA。

一 (1) 個 FMC+ 連接器。

(20) 個 28 Gbps 收發(fā)器，由一 (1) 個 FMC+ 連接器提供支持

HMC DRAM

簡單 USB 3.0 端口接口。

隨附兩張微型 SD 卡，“TRX”用于 ADRV9026 評估板，“HSX”用于 MxFE™ 評估板。

(素材來源：analog.如涉版權(quán)請聯(lián)系刪除。特別感謝）

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