300MHz的DSP并行處理速度CPLD和FPGA解決方案
發(fā)布時(shí)間:2020/12/22 21:42:30 訪問(wèn)次數(shù):923
汽車制造商會(huì)儲(chǔ)存通用的器件而不是幾種不同用途的零件,減少庫(kù)存量。同樣,因?yàn)樾酒谡麄(gè)設(shè)計(jì)周期都可編程,汽車電子工程師能把娛樂(lè)和導(dǎo)航系統(tǒng)產(chǎn)品隨時(shí)升級(jí)。
最初提供的產(chǎn)品包括各種的CPLD和FPGA解決方案,工作在-40°C到125°C的溫床范圍內(nèi),它們是3.3-V XC9500XL CPLDs 和 3.3-V Spartan-XL FPGAs。
可編程邏輯器件提供比傳統(tǒng)的專用集成電路(ASIC)更快的設(shè)計(jì)周期。器件也不承擔(dān)非經(jīng)常性工程成本。FPGA和CPLD能提供超過(guò)300MHz的DSP并行處理速度,能合適地代替汽車電子市場(chǎng)中傳統(tǒng)的MCU和微處理器。
PCI Express * Gen 2.1 (2.5GT/s),高績(jī)效設(shè)計(jì)
單端口PCI-Express * 10/100/1000Mbps以太網(wǎng)網(wǎng)卡
創(chuàng)新的電源管理功能:
包括節(jié)能以太網(wǎng) (EEE),DMA聚結(jié),超緊湊設(shè)計(jì),以及獨(dú)特的通風(fēng)支架,可提高效率并降低功耗。
IEEE 802.1Qav音頻 - 視頻橋接(AVB),用于嚴(yán)格控制的媒體流同步,緩沖和預(yù)留
兼容性可靠,且經(jīng)過(guò)驗(yàn)證的千兆以太網(wǎng)技術(shù)
產(chǎn)品基于Actel新的AX結(jié)構(gòu)和可縮放平臺(tái),消除傳統(tǒng)低速內(nèi)核結(jié)構(gòu)的FPGA器件用在高速通信和橋接領(lǐng)域性能上出現(xiàn)的瓶頸。
Axcelerator 系列產(chǎn)品基于0.15微米、七層金屬反熔絲工藝,密度在125,000門 到200萬(wàn)系統(tǒng)門之間,可為業(yè)界提供最強(qiáng)大的內(nèi)核性能,工作頻率在500兆以上,資源利用率高達(dá)100%。
大部分FPGA產(chǎn)品的內(nèi)部邏輯核心的速度仍能與系統(tǒng)性能保持一致。對(duì)通信系統(tǒng)性能要求的大幅提升,F(xiàn)PGA器件經(jīng)常不能夠以線速處理通過(guò)芯片的數(shù)據(jù),迫使設(shè)計(jì)人員利用繁復(fù)的流水線技術(shù)和冗余邏輯來(lái)達(dá)到所需的系統(tǒng)數(shù)據(jù)通量。

(素材來(lái)源:eccn和ttic.如涉版權(quán)請(qǐng)聯(lián)系刪除。特別感謝)
汽車制造商會(huì)儲(chǔ)存通用的器件而不是幾種不同用途的零件,減少庫(kù)存量。同樣,因?yàn)樾酒谡麄(gè)設(shè)計(jì)周期都可編程,汽車電子工程師能把娛樂(lè)和導(dǎo)航系統(tǒng)產(chǎn)品隨時(shí)升級(jí)。
最初提供的產(chǎn)品包括各種的CPLD和FPGA解決方案,工作在-40°C到125°C的溫床范圍內(nèi),它們是3.3-V XC9500XL CPLDs 和 3.3-V Spartan-XL FPGAs。
可編程邏輯器件提供比傳統(tǒng)的專用集成電路(ASIC)更快的設(shè)計(jì)周期。器件也不承擔(dān)非經(jīng)常性工程成本。FPGA和CPLD能提供超過(guò)300MHz的DSP并行處理速度,能合適地代替汽車電子市場(chǎng)中傳統(tǒng)的MCU和微處理器。
PCI Express * Gen 2.1 (2.5GT/s),高績(jī)效設(shè)計(jì)
單端口PCI-Express * 10/100/1000Mbps以太網(wǎng)網(wǎng)卡
創(chuàng)新的電源管理功能:
包括節(jié)能以太網(wǎng) (EEE),DMA聚結(jié),超緊湊設(shè)計(jì),以及獨(dú)特的通風(fēng)支架,可提高效率并降低功耗。
IEEE 802.1Qav音頻 - 視頻橋接(AVB),用于嚴(yán)格控制的媒體流同步,緩沖和預(yù)留
兼容性可靠,且經(jīng)過(guò)驗(yàn)證的千兆以太網(wǎng)技術(shù)
產(chǎn)品基于Actel新的AX結(jié)構(gòu)和可縮放平臺(tái),消除傳統(tǒng)低速內(nèi)核結(jié)構(gòu)的FPGA器件用在高速通信和橋接領(lǐng)域性能上出現(xiàn)的瓶頸。
Axcelerator 系列產(chǎn)品基于0.15微米、七層金屬反熔絲工藝,密度在125,000門 到200萬(wàn)系統(tǒng)門之間,可為業(yè)界提供最強(qiáng)大的內(nèi)核性能,工作頻率在500兆以上,資源利用率高達(dá)100%。
大部分FPGA產(chǎn)品的內(nèi)部邏輯核心的速度仍能與系統(tǒng)性能保持一致。對(duì)通信系統(tǒng)性能要求的大幅提升,F(xiàn)PGA器件經(jīng)常不能夠以線速處理通過(guò)芯片的數(shù)據(jù),迫使設(shè)計(jì)人員利用繁復(fù)的流水線技術(shù)和冗余邏輯來(lái)達(dá)到所需的系統(tǒng)數(shù)據(jù)通量。

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