差動(dòng)放大電路輸人部分與輸出部分距離遠(yuǎn)一些增設(shè)屏蔽隔板
發(fā)布時(shí)間:2023/4/27 22:25:47 訪問(wèn)次數(shù):55
集成邏輯門電路,TL與非門電路,電路大致由輸人級(jí)、倒相級(jí)和輸出級(jí)組成,由于其輸人端和輸出端都是三極管結(jié)構(gòu),叉稱三極管一三極管邏輯電路。
CT54/74H系列L與非門典型電路,V3、R1組成輸入級(jí),Ⅴ4、R2、R3組成倒相級(jí),Ⅴ5、Ⅴ6、Ⅴ7、R4、R5組成輸出級(jí)。
用卡諾圖法化簡(jiǎn)邏輯函數(shù) 首先把函數(shù)變換為與或表達(dá)式,畫出卡諾圖。在卡諾圖上將2個(gè)為1的相鄰方格分別畫成方格群,整理每個(gè)方格群的公因子作為乘積項(xiàng),最后把整理后的乘積項(xiàng)相加起來(lái),就形成化簡(jiǎn)后的與或表達(dá)式。
化簡(jiǎn)時(shí),應(yīng)遵循下列幾項(xiàng)原則:
所謂2個(gè)1相鄰畫成一個(gè)方格群是指而=0,1,2,3,4時(shí)分別為1個(gè)1,2個(gè)1,4個(gè)1,8個(gè)1,16個(gè)1相鄰構(gòu)成方形(或矩形)。
包圍圈越大,方格群中包含的最小頁(yè)(2″個(gè))越多,公因子越少,化簡(jiǎn)結(jié)果越簡(jiǎn)單。
畫包圍圈時(shí),最小項(xiàng)可以被重復(fù)包圍,但每個(gè)方格群至少要有一個(gè)最小項(xiàng)與其他方格群不重復(fù)。
必須把函數(shù)的全部最小項(xiàng)都圈完,方格群的個(gè)數(shù)越少越好。
由于這三種元件都具有自關(guān)斷功能和輸出輸入的快速響應(yīng),比晶間管逆變器和斬波器在電路結(jié)構(gòu)上更簡(jiǎn)單、效率更高、成本更低,因而應(yīng)用越來(lái)越廣泛,如用于開關(guān)穩(wěn)壓電源、變頻調(diào)速裝置等。
電子設(shè)備防干擾知識(shí),由于電子設(shè)各的元件輸人信號(hào)較小,并且一般放大倍數(shù)都比較大,因此極易受外界的干擾而產(chǎn)生誤動(dòng)作。
集成邏輯門電路,TL與非門電路,電路大致由輸人級(jí)、倒相級(jí)和輸出級(jí)組成,由于其輸人端和輸出端都是三極管結(jié)構(gòu),叉稱三極管一三極管邏輯電路。
CT54/74H系列L與非門典型電路,V3、R1組成輸入級(jí),Ⅴ4、R2、R3組成倒相級(jí),Ⅴ5、Ⅴ6、Ⅴ7、R4、R5組成輸出級(jí)。
用卡諾圖法化簡(jiǎn)邏輯函數(shù) 首先把函數(shù)變換為與或表達(dá)式,畫出卡諾圖。在卡諾圖上將2個(gè)為1的相鄰方格分別畫成方格群,整理每個(gè)方格群的公因子作為乘積項(xiàng),最后把整理后的乘積項(xiàng)相加起來(lái),就形成化簡(jiǎn)后的與或表達(dá)式。
化簡(jiǎn)時(shí),應(yīng)遵循下列幾項(xiàng)原則:
所謂2個(gè)1相鄰畫成一個(gè)方格群是指而=0,1,2,3,4時(shí)分別為1個(gè)1,2個(gè)1,4個(gè)1,8個(gè)1,16個(gè)1相鄰構(gòu)成方形(或矩形)。
包圍圈越大,方格群中包含的最小頁(yè)(2″個(gè))越多,公因子越少,化簡(jiǎn)結(jié)果越簡(jiǎn)單。
畫包圍圈時(shí),最小項(xiàng)可以被重復(fù)包圍,但每個(gè)方格群至少要有一個(gè)最小項(xiàng)與其他方格群不重復(fù)。
必須把函數(shù)的全部最小項(xiàng)都圈完,方格群的個(gè)數(shù)越少越好。
由于這三種元件都具有自關(guān)斷功能和輸出輸入的快速響應(yīng),比晶間管逆變器和斬波器在電路結(jié)構(gòu)上更簡(jiǎn)單、效率更高、成本更低,因而應(yīng)用越來(lái)越廣泛,如用于開關(guān)穩(wěn)壓電源、變頻調(diào)速裝置等。
電子設(shè)備防干擾知識(shí),由于電子設(shè)各的元件輸人信號(hào)較小,并且一般放大倍數(shù)都比較大,因此極易受外界的干擾而產(chǎn)生誤動(dòng)作。
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