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高可靠性存儲(chǔ)子系統(tǒng)適合I/O控制器連接單端口磁盤驅(qū)動(dòng)器應(yīng)用

發(fā)布時(shí)間:2023/11/4 16:49:06 訪問次數(shù):124

一款串行ATA分配器、緩沖器,可為1.5Gbps和3.0Gbps鏈路實(shí)現(xiàn)2:1容錯(cuò)切換。

對(duì)于冗余、負(fù)載分配非常關(guān)鍵的高可靠性存儲(chǔ)子系統(tǒng),這項(xiàng)功能非常適合雙主機(jī)(例如I/O控制器)必須連接單端口磁盤驅(qū)動(dòng)器的應(yīng)用。I/O控制器的輸出復(fù)用到串行ATA驅(qū)動(dòng)器,串行ATA驅(qū)動(dòng)器的輸出經(jīng)過緩存,復(fù)制到I/O控制器。

從一個(gè)I/O控制器切換至另一個(gè)時(shí),串行ATA鏈路必須使用外帶數(shù)據(jù)(OOB)信號(hào)重新初始化,這將通過VSC7173透明傳輸。

在SATA背板、SATA磁盤陣列等應(yīng)用中,需要多個(gè)SATA Host訪問同一SATA硬盤,或者為主機(jī)系統(tǒng)提供冗余的訪問通道,以提高系統(tǒng)的可靠性。使用VSC7173可方便的實(shí)現(xiàn)SATA端口的復(fù)用,實(shí)現(xiàn)上述功能。

在電路設(shè)計(jì)中,考慮到Host的連接線可能較長,Port0和Port1均設(shè)為輸出預(yù)加重(拉高HIV0和HIV1)。用戶可控制PORTSEL0引腳的高低電平,實(shí)現(xiàn)不同的SATA Host與硬盤的連接。


此外,該器件運(yùn)行只需要很少的外部組件。QT1060以擴(kuò)頻方式進(jìn)行觸發(fā),從而抑制外部噪聲的影響和RF發(fā)射。

Silicon Labs并提供三個(gè)完整的參考設(shè)計(jì)以支持PSE子板和主板實(shí)作。

額外的高性能加速器和外設(shè)接口,并為蜂窩式基礎(chǔ)局端產(chǎn)品進(jìn)行了優(yōu)化。

每個(gè)DSP內(nèi)核都包含一個(gè)可加速LTE CQI信息解碼的RSA單元,這對(duì)于20MHz LTE系統(tǒng)而言,相當(dāng)于每個(gè)區(qū)段可節(jié)約高達(dá)1GHz的處理器資源。

電壓模式控制實(shí)現(xiàn)穩(wěn)定工作和外部補(bǔ)償,因而可以對(duì)環(huán)路增益進(jìn)行調(diào)節(jié),從而優(yōu)化器件選擇和瞬態(tài)響應(yīng)。器件可與SYNC輸入端的外部時(shí)鐘同步。

http://tx168.51dzw.com


一款串行ATA分配器、緩沖器,可為1.5Gbps和3.0Gbps鏈路實(shí)現(xiàn)2:1容錯(cuò)切換。

對(duì)于冗余、負(fù)載分配非常關(guān)鍵的高可靠性存儲(chǔ)子系統(tǒng),這項(xiàng)功能非常適合雙主機(jī)(例如I/O控制器)必須連接單端口磁盤驅(qū)動(dòng)器的應(yīng)用。I/O控制器的輸出復(fù)用到串行ATA驅(qū)動(dòng)器,串行ATA驅(qū)動(dòng)器的輸出經(jīng)過緩存,復(fù)制到I/O控制器。

從一個(gè)I/O控制器切換至另一個(gè)時(shí),串行ATA鏈路必須使用外帶數(shù)據(jù)(OOB)信號(hào)重新初始化,這將通過VSC7173透明傳輸。

在SATA背板、SATA磁盤陣列等應(yīng)用中,需要多個(gè)SATA Host訪問同一SATA硬盤,或者為主機(jī)系統(tǒng)提供冗余的訪問通道,以提高系統(tǒng)的可靠性。使用VSC7173可方便的實(shí)現(xiàn)SATA端口的復(fù)用,實(shí)現(xiàn)上述功能。

在電路設(shè)計(jì)中,考慮到Host的連接線可能較長,Port0和Port1均設(shè)為輸出預(yù)加重(拉高HIV0和HIV1)。用戶可控制PORTSEL0引腳的高低電平,實(shí)現(xiàn)不同的SATA Host與硬盤的連接。


此外,該器件運(yùn)行只需要很少的外部組件。QT1060以擴(kuò)頻方式進(jìn)行觸發(fā),從而抑制外部噪聲的影響和RF發(fā)射。

Silicon Labs并提供三個(gè)完整的參考設(shè)計(jì)以支持PSE子板和主板實(shí)作。

額外的高性能加速器和外設(shè)接口,并為蜂窩式基礎(chǔ)局端產(chǎn)品進(jìn)行了優(yōu)化。

每個(gè)DSP內(nèi)核都包含一個(gè)可加速LTE CQI信息解碼的RSA單元,這對(duì)于20MHz LTE系統(tǒng)而言,相當(dāng)于每個(gè)區(qū)段可節(jié)約高達(dá)1GHz的處理器資源。

電壓模式控制實(shí)現(xiàn)穩(wěn)定工作和外部補(bǔ)償,因而可以對(duì)環(huán)路增益進(jìn)行調(diào)節(jié),從而優(yōu)化器件選擇和瞬態(tài)響應(yīng)。器件可與SYNC輸入端的外部時(shí)鐘同步。

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