SFI-4接口的時鐘方案
發(fā)布時間:2008/9/19 0:00:00 訪問次數(shù):618
對于sfi-4接口設(shè)計來說，輸入時鐘頻率較高，為622.08 mhz。由于該時鐘不是內(nèi)部fpga能處理的系統(tǒng)頻率，所以時鐘設(shè)計顯得更加重要。xilinx virtex-5器件內(nèi)部提供了高速的i/o時鐘和區(qū)域時鐘網(wǎng)絡(luò)，io時鐘能處理的接口頻率高達710 mhz。而普通的全局時鐘網(wǎng)絡(luò)處理頻率不超過600 mhz，因此必須利用lo時鐘bufio和區(qū)域時鐘bufr來設(shè)計sfi-4接口的時鐘方案。接收端的時鐘如圖所示，發(fā)送端的時鐘如圖2所示，分別對應(yīng)于rxclocking模塊和tx clocking模塊。
圖 接收端的時鐘
歡迎轉(zhuǎn)載,信息來自維庫電子市場網(wǎng)（www.dzsc.com）
對于sfi-4接口設(shè)計來說，輸入時鐘頻率較高，為622.08 mhz。由于該時鐘不是內(nèi)部fpga能處理的系統(tǒng)頻率，所以時鐘設(shè)計顯得更加重要。xilinx virtex-5器件內(nèi)部提供了高速的i/o時鐘和區(qū)域時鐘網(wǎng)絡(luò)，io時鐘能處理的接口頻率高達710 mhz。而普通的全局時鐘網(wǎng)絡(luò)處理頻率不超過600 mhz，因此必須利用lo時鐘bufio和區(qū)域時鐘bufr來設(shè)計sfi-4接口的時鐘方案。接收端的時鐘如圖所示，發(fā)送端的時鐘如圖2所示，分別對應(yīng)于rxclocking模塊和tx clocking模塊。
圖 接收端的時鐘
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