使用lC的優(yōu)缺點(diǎn)
發(fā)布時(shí)間:2012/8/14 19:58:59 訪問(wèn)次數(shù):1264
1．電子電LM2940CT-12路中使用IC的優(yōu)點(diǎn)
(1)可以減少部件數(shù)目。IC是將一個(gè)電路原封不動(dòng)地封裝在一個(gè)管殼中。因此，使用IC可以減少構(gòu)成電路的部件數(shù)目。將電路集成化并封裝起來(lái)，使得電路整體變小了。
(2)縮短了設(shè)計(jì)時(shí)間。將具有嚴(yán)格的常數(shù)設(shè)定的電路IC化，能夠縮短設(shè)計(jì)時(shí)間。如果所有電路都集成化，那么“電路設(shè)計(jì)”就變成了選擇IC的工作。
(3)降低了成本。通過(guò)將標(biāo)準(zhǔn)的電路集成化批量生產(chǎn)，能夠降低IC自身的格，從而使電路整體的成本下降。
2．使用IC的缺點(diǎn)
(1)只能在一定程度上滿足其性能要求。為了使通常的IC具有更廣泛的應(yīng)
用，需要將一定程度上標(biāo)準(zhǔn)化的電路集成化。因此，使用IC時(shí)，在性能上必然會(huì)有一定的妥協(xié)。所以說(shuō)，使用IC的電路并不能得到非常完美的性能。
(2)不能夠變更內(nèi)部電路。這是顯而j見(jiàn)的事情。已經(jīng)制成的電路以及管腳配置是不能夠變更的。但是在數(shù)字IC領(lǐng)域，使用者在一定程度上具有變更內(nèi)部電路管或腳配置的自由，例如PLD(Programmable Logic Device，可編程邏輯器件)。在將來(lái)，模擬IC中也會(huì)具有這種功能。
使用晶體管和FET的優(yōu)缺點(diǎn)
1．電子電路中使用晶體管和FET的優(yōu)點(diǎn)
(1)能夠?qū)崿F(xiàn)高性能。IC內(nèi)部的半導(dǎo)體器件由于受制造條件的制約，其性能往往低于分立器件。因此設(shè)計(jì)者使用分立器件能夠制作出比IC性能更優(yōu)良的電路。
(2)什么樣的電路都能夠制作。晶體管和FET是放大單元、開(kāi)關(guān)單元的最小單位，所以具有制作任何電路的可能性。
2．使用晶體管和FET的缺點(diǎn)
(1)增加了部件數(shù)目。如果一個(gè)電路使用2～3個(gè)IC就能夠制成，那么使用分立器件時(shí)需要的部件數(shù)目將會(huì)增加到20～30個(gè)。
(2)設(shè)計(jì)周期長(zhǎng)。由于必須選擇和確定電路所需要的所有元器件及其數(shù)值，所以花費(fèi)的時(shí)間長(zhǎng)。
(3)成本高。不能說(shuō)所有情況下的成本都高，但是大多數(shù)情況下，由于使用的分立器仵多，整體上成本（也考慮到制造成本）提高了。
(1)可以減少部件數(shù)目。IC是將一個(gè)電路原封不動(dòng)地封裝在一個(gè)管殼中。因此，使用IC可以減少構(gòu)成電路的部件數(shù)目。將電路集成化并封裝起來(lái)，使得電路整體變小了。
(2)縮短了設(shè)計(jì)時(shí)間。將具有嚴(yán)格的常數(shù)設(shè)定的電路IC化，能夠縮短設(shè)計(jì)時(shí)間。如果所有電路都集成化，那么“電路設(shè)計(jì)”就變成了選擇IC的工作。
(3)降低了成本。通過(guò)將標(biāo)準(zhǔn)的電路集成化批量生產(chǎn)，能夠降低IC自身的格，從而使電路整體的成本下降。
2．使用IC的缺點(diǎn)
(1)只能在一定程度上滿足其性能要求。為了使通常的IC具有更廣泛的應(yīng)
用，需要將一定程度上標(biāo)準(zhǔn)化的電路集成化。因此，使用IC時(shí)，在性能上必然會(huì)有一定的妥協(xié)。所以說(shuō)，使用IC的電路并不能得到非常完美的性能。
(2)不能夠變更內(nèi)部電路。這是顯而j見(jiàn)的事情。已經(jīng)制成的電路以及管腳配置是不能夠變更的。但是在數(shù)字IC領(lǐng)域，使用者在一定程度上具有變更內(nèi)部電路管或腳配置的自由，例如PLD(Programmable Logic Device，可編程邏輯器件)。在將來(lái)，模擬IC中也會(huì)具有這種功能。
使用晶體管和FET的優(yōu)缺點(diǎn)
1．電子電路中使用晶體管和FET的優(yōu)點(diǎn)
(1)能夠?qū)崿F(xiàn)高性能。IC內(nèi)部的半導(dǎo)體器件由于受制造條件的制約，其性能往往低于分立器件。因此設(shè)計(jì)者使用分立器件能夠制作出比IC性能更優(yōu)良的電路。
(2)什么樣的電路都能夠制作。晶體管和FET是放大單元、開(kāi)關(guān)單元的最小單位，所以具有制作任何電路的可能性。
2．使用晶體管和FET的缺點(diǎn)
(1)增加了部件數(shù)目。如果一個(gè)電路使用2～3個(gè)IC就能夠制成，那么使用分立器件時(shí)需要的部件數(shù)目將會(huì)增加到20～30個(gè)。
(2)設(shè)計(jì)周期長(zhǎng)。由于必須選擇和確定電路所需要的所有元器件及其數(shù)值，所以花費(fèi)的時(shí)間長(zhǎng)。
(3)成本高。不能說(shuō)所有情況下的成本都高，但是大多數(shù)情況下，由于使用的分立器仵多，整體上成本（也考慮到制造成本）提高了。
1．電子電LM2940CT-12路中使用IC的優(yōu)點(diǎn)
(1)可以減少部件數(shù)目。IC是將一個(gè)電路原封不動(dòng)地封裝在一個(gè)管殼中。因此，使用IC可以減少構(gòu)成電路的部件數(shù)目。將電路集成化并封裝起來(lái)，使得電路整體變小了。
(2)縮短了設(shè)計(jì)時(shí)間。將具有嚴(yán)格的常數(shù)設(shè)定的電路IC化，能夠縮短設(shè)計(jì)時(shí)間。如果所有電路都集成化，那么“電路設(shè)計(jì)”就變成了選擇IC的工作。
(3)降低了成本。通過(guò)將標(biāo)準(zhǔn)的電路集成化批量生產(chǎn)，能夠降低IC自身的格，從而使電路整體的成本下降。
2．使用IC的缺點(diǎn)
(1)只能在一定程度上滿足其性能要求。為了使通常的IC具有更廣泛的應(yīng)
用，需要將一定程度上標(biāo)準(zhǔn)化的電路集成化。因此，使用IC時(shí)，在性能上必然會(huì)有一定的妥協(xié)。所以說(shuō)，使用IC的電路并不能得到非常完美的性能。
(2)不能夠變更內(nèi)部電路。這是顯而j見(jiàn)的事情。已經(jīng)制成的電路以及管腳配置是不能夠變更的。但是在數(shù)字IC領(lǐng)域，使用者在一定程度上具有變更內(nèi)部電路管或腳配置的自由，例如PLD(Programmable Logic Device，可編程邏輯器件)。在將來(lái)，模擬IC中也會(huì)具有這種功能。
使用晶體管和FET的優(yōu)缺點(diǎn)
1．電子電路中使用晶體管和FET的優(yōu)點(diǎn)
(1)能夠?qū)崿F(xiàn)高性能。IC內(nèi)部的半導(dǎo)體器件由于受制造條件的制約，其性能往往低于分立器件。因此設(shè)計(jì)者使用分立器件能夠制作出比IC性能更優(yōu)良的電路。
(2)什么樣的電路都能夠制作。晶體管和FET是放大單元、開(kāi)關(guān)單元的最小單位，所以具有制作任何電路的可能性。
2．使用晶體管和FET的缺點(diǎn)
(1)增加了部件數(shù)目。如果一個(gè)電路使用2～3個(gè)IC就能夠制成，那么使用分立器件時(shí)需要的部件數(shù)目將會(huì)增加到20～30個(gè)。
(2)設(shè)計(jì)周期長(zhǎng)。由于必須選擇和確定電路所需要的所有元器件及其數(shù)值，所以花費(fèi)的時(shí)間長(zhǎng)。
(3)成本高。不能說(shuō)所有情況下的成本都高，但是大多數(shù)情況下，由于使用的分立器仵多，整體上成本（也考慮到制造成本）提高了。
(1)可以減少部件數(shù)目。IC是將一個(gè)電路原封不動(dòng)地封裝在一個(gè)管殼中。因此，使用IC可以減少構(gòu)成電路的部件數(shù)目。將電路集成化并封裝起來(lái)，使得電路整體變小了。
(2)縮短了設(shè)計(jì)時(shí)間。將具有嚴(yán)格的常數(shù)設(shè)定的電路IC化，能夠縮短設(shè)計(jì)時(shí)間。如果所有電路都集成化，那么“電路設(shè)計(jì)”就變成了選擇IC的工作。
(3)降低了成本。通過(guò)將標(biāo)準(zhǔn)的電路集成化批量生產(chǎn)，能夠降低IC自身的格，從而使電路整體的成本下降。
2．使用IC的缺點(diǎn)
(1)只能在一定程度上滿足其性能要求。為了使通常的IC具有更廣泛的應(yīng)
用，需要將一定程度上標(biāo)準(zhǔn)化的電路集成化。因此，使用IC時(shí)，在性能上必然會(huì)有一定的妥協(xié)。所以說(shuō)，使用IC的電路并不能得到非常完美的性能。
(2)不能夠變更內(nèi)部電路。這是顯而j見(jiàn)的事情。已經(jīng)制成的電路以及管腳配置是不能夠變更的。但是在數(shù)字IC領(lǐng)域，使用者在一定程度上具有變更內(nèi)部電路管或腳配置的自由，例如PLD(Programmable Logic Device，可編程邏輯器件)。在將來(lái)，模擬IC中也會(huì)具有這種功能。
使用晶體管和FET的優(yōu)缺點(diǎn)
1．電子電路中使用晶體管和FET的優(yōu)點(diǎn)
(1)能夠?qū)崿F(xiàn)高性能。IC內(nèi)部的半導(dǎo)體器件由于受制造條件的制約，其性能往往低于分立器件。因此設(shè)計(jì)者使用分立器件能夠制作出比IC性能更優(yōu)良的電路。
(2)什么樣的電路都能夠制作。晶體管和FET是放大單元、開(kāi)關(guān)單元的最小單位，所以具有制作任何電路的可能性。
2．使用晶體管和FET的缺點(diǎn)
(1)增加了部件數(shù)目。如果一個(gè)電路使用2～3個(gè)IC就能夠制成，那么使用分立器件時(shí)需要的部件數(shù)目將會(huì)增加到20～30個(gè)。
(2)設(shè)計(jì)周期長(zhǎng)。由于必須選擇和確定電路所需要的所有元器件及其數(shù)值，所以花費(fèi)的時(shí)間長(zhǎng)。
(3)成本高。不能說(shuō)所有情況下的成本都高，但是大多數(shù)情況下，由于使用的分立器仵多，整體上成本（也考慮到制造成本）提高了。
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