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FPGA邏輯功能設(shè)計(jì)

發(fā)布時(shí)間:2014/7/22 20:28:26 訪問(wèn)次數(shù):566

   頂層原理圖如圖7. 42所示。

   圖7. 42中,輸入:KMC為1024 Hz的脈沖,電流快速置數(shù)用;MCP為電壓電流步進(jìn)增加或減少脈沖;YZKZ為預(yù)置控制電平信號(hào);JJKZ為電壓電流步進(jìn)增加或減少電平控制信號(hào);XZSC為受控電壓電流選擇信號(hào)。 HD6475348F6輸出:BW[60]SW[6—0]GW[6—0]為顯示輸出電流;D[7..0]為受控的電壓電流數(shù)字量輸出;YSW[6. OlYGW[6.O]為控制電流變化的數(shù)字量輸出。

    圖7. 42中上半部分為數(shù)控電流輸出,主要由yltfpq12模塊(1到2分頻器)、GCNT200(20-200進(jìn)制加法計(jì)數(shù)器模塊)、GJF200模塊(200-20進(jìn)制減法計(jì)數(shù)器)、MUX12 21模塊(12個(gè)2選1數(shù)據(jù)選擇器)、ZHDL( BCD碼轉(zhuǎn)二進(jìn)制模塊)組成。

   圖7. 42中下半部分為數(shù)控電壓輸出,主要由J8JF模塊(8位二進(jìn)制加法計(jì)數(shù)器)、C8JJ模塊(8位二進(jìn)制減法計(jì)數(shù)器)、MUX821模塊(8個(gè)2選l數(shù)據(jù)選擇器)組成。

   右邊的MUX821模塊(8個(gè)2選1數(shù)據(jù)選擇器)用于選擇受控的


電流或電壓數(shù)字量輸出。

         


   頂層原理圖如圖7. 42所示。

   圖7. 42中,輸入:KMC為1024 Hz的脈沖,電流快速置數(shù)用;MCP為電壓電流步進(jìn)增加或減少脈沖;YZKZ為預(yù)置控制電平信號(hào);JJKZ為電壓電流步進(jìn)增加或減少電平控制信號(hào);XZSC為受控電壓電流選擇信號(hào)。 HD6475348F6輸出:BW[60]SW[6—0]GW[6—0]為顯示輸出電流;D[7..0]為受控的電壓電流數(shù)字量輸出;YSW[6. OlYGW[6.O]為控制電流變化的數(shù)字量輸出。

    圖7. 42中上半部分為數(shù)控電流輸出,主要由yltfpq12模塊(1到2分頻器)、GCNT200(20-200進(jìn)制加法計(jì)數(shù)器模塊)、GJF200模塊(200-20進(jìn)制減法計(jì)數(shù)器)、MUX12 21模塊(12個(gè)2選1數(shù)據(jù)選擇器)、ZHDL( BCD碼轉(zhuǎn)二進(jìn)制模塊)組成。

   圖7. 42中下半部分為數(shù)控電壓輸出,主要由J8JF模塊(8位二進(jìn)制加法計(jì)數(shù)器)、C8JJ模塊(8位二進(jìn)制減法計(jì)數(shù)器)、MUX821模塊(8個(gè)2選l數(shù)據(jù)選擇器)組成。

   右邊的MUX821模塊(8個(gè)2選1數(shù)據(jù)選擇器)用于選擇受控的


電流或電壓數(shù)字量輸出。

         


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