版圖設(shè)計(jì)概述及軟件工冥介紹
發(fā)布時(shí)間:2016/6/28 21:30:06 訪問次數(shù):466
成電路的設(shè)計(jì)過程中,版圖設(shè)計(jì)是繼性能指標(biāo)確定、模型分析、邏輯綜合、AD621ARZ具體線路設(shè)計(jì)和電路整體仿真等步驟之后的最后一步,同時(shí)也是最關(guān)鍵的一步。它決定了前期階段的既定設(shè)計(jì)功能能否最終實(shí)現(xiàn)和性能指標(biāo)能否最終滿足要求。版圖設(shè)計(jì)過程包括單元庫建立、布局、布線、設(shè)計(jì)規(guī)則檢查(Dcsign RulesChcck,DRC)及版圖對(duì)照原理圖(Lγout Versus Schcm扯ic,LVs)檢查等。版圖設(shè)計(jì)定義為制造集成電路時(shí),所用的掩模版上的幾何圖形,這些幾何圖形包括:N阱、有源區(qū)、多晶硅、N+注入、蘆注入、接觸孔以及金屬層,其流程如圖8.8所示。
成電路的設(shè)計(jì)過程中,版圖設(shè)計(jì)是繼性能指標(biāo)確定、模型分析、邏輯綜合、AD621ARZ具體線路設(shè)計(jì)和電路整體仿真等步驟之后的最后一步,同時(shí)也是最關(guān)鍵的一步。它決定了前期階段的既定設(shè)計(jì)功能能否最終實(shí)現(xiàn)和性能指標(biāo)能否最終滿足要求。版圖設(shè)計(jì)過程包括單元庫建立、布局、布線、設(shè)計(jì)規(guī)則檢查(Dcsign RulesChcck,DRC)及版圖對(duì)照原理圖(Lγout Versus Schcm扯ic,LVs)檢查等。版圖設(shè)計(jì)定義為制造集成電路時(shí),所用的掩模版上的幾何圖形,這些幾何圖形包括:N阱、有源區(qū)、多晶硅、N+注入、蘆注入、接觸孔以及金屬層,其流程如圖8.8所示。
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