Verilog討論組精彩內(nèi)容摘錄(三)

發(fā)布時間:2008/6/5 0:00:00 訪問次數(shù):516

　　問題一：
　　在下才疏學(xué)淺，一直在用lattice的isplsi，搞了一些小應(yīng)用，看到各位都在談?wù)搙ilinx和altera，本人沒有機會嘗試，究竟哪一種比較好，請高人不吝賜教。

回答一：
　　lattice 的isplsi我畢業(yè)設(shè)計時用過一枚，感覺其在系統(tǒng)編程是十分方便的，但熔絲圖的生成好象要ispexper這一專門軟件，他支持原理圖輸入和vhdl輸入等，十分方便且０具有邏輯與時序仿真，其燒錄速度（根據(jù)熔絲圖大小）相當(dāng)快，一般幾秒鐘就行了。

回答二：
　　1、首先可編程器件從結(jié)構(gòu)上分為cpld和fpga二類，從制造工藝上有cmos、flash、sram、反熔絲等幾種。
　　2、cpld一般來講容量較低（注意cpld和fpga的門數(shù)的定義不一樣，實際上對門沒有統(tǒng)一的定義，不能認為cpld的10000門的規(guī)模就比5000門的規(guī)模大，我們比較能接受的是在asic中定義一個與非門為一個門）。cpld的速度一般都較快，時延比較確定（注意：實際設(shè)計的時延和速度都要通過時序仿真才能確定，一般來講器件資料中所提到的最高速度在實際設(shè)計中是不可能達到的，因為所謂的最高速度是指的一級設(shè)計，并且會bypass一些路徑。）這和它的結(jié)構(gòu)有關(guān)，如：lattice有g(shù)rp概念，xilinx的9500則提出快速交換矩陣的思想，目的都是為了達到較快的速度。通過對cpld的結(jié)構(gòu)分析就會發(fā)現(xiàn)cpld的邏輯功能比ffs要多。cpld一般采用cmos和flash工藝，cmos的功耗大，但下載的速度快，flash的功耗很小，但加載的時間較長，當(dāng)然還和實際設(shè)計的一些情況有關(guān)，如：頻率、利用率等。
　　3、fpga是相對cpld而言的，它的規(guī)�？梢韵喈�(dāng)大。從結(jié)構(gòu)上講也是大同小異的，一般是由最基本的cell組成，cell內(nèi)部是lut和ffs，比較綜合考慮了的邏輯和ff的比例關(guān)系，當(dāng)然仔細看的話，每家的結(jié)構(gòu)還是有一些特點的。fpga的內(nèi)部布線資源是很豐富的，要設(shè)計好fpga必須充分了解所有的資源情況，并合理地利用。fpga的一個很大特點是時延不確定，不同的編譯有不同的結(jié)果，這一定要牢記！如果設(shè)計不好會遇到有些板子可以工作，而有的板子就是不行，盡管用的同一個fpga數(shù)據(jù)。
　　4、cpld和fpga不存在哪個好，要根據(jù)你的實際情況而選擇。
　　草草寫一下，以后最談。
問題二：
　　你好!我想請教幾個問題:
　　1、什么是ffs
　　2、在fpga時延不確定的情況下,怎樣的設(shè)計才能保證該設(shè)計是比較好的設(shè)計,而不會出現(xiàn)盡管用的同一個fpga數(shù)據(jù)有些板子可以工作，而有的板子就是不行這種情況呢?
　　謝謝!

回答一：
　　1、ffs:觸發(fā)器。
　　2、優(yōu)化設(shè)計；盡量采用同步設(shè)計；高速、多驅(qū)動通道用全局緩充驅(qū)動，合理利用長線資源等。

回答二：
　　ff 是指 flip flop，也就是觸發(fā)器的最基本單元。
　　fpga設(shè)計的時候需要特別注意最后實現(xiàn)時的最大延時，如果各條線路的最大延時能夠滿足條件，一般就不會出現(xiàn)什么太大的問題。另外，有些公司已經(jīng)推出了固定延時的fpga，只是xilinx公司還沒有。

回答三：
　　 the all effect factor, it is important that man-resource and design solution. to fpga, cplds, lattice , altera, xilinx are all very good, to marketing share, the xilinx is most high.

　　 we can design very good function , even discret logic. do you think so? lattice, altera ,xilins , it only is tools. man is no.1 for ever, so that you did not must study altera, xilinx.

　　問題一：
　　在下才疏學(xué)淺，一直在用lattice的isplsi，搞了一些小應(yīng)用，看到各位都在談?wù)搙ilinx和altera，本人沒有機會嘗試，究竟哪一種比較好，請高人不吝賜教。

回答一：
　　lattice 的isplsi我畢業(yè)設(shè)計時用過一枚，感覺其在系統(tǒng)編程是十分方便的，但熔絲圖的生成好象要ispexper這一專門軟件，他支持原理圖輸入和vhdl輸入等，十分方便且０具有邏輯與時序仿真，其燒錄速度（根據(jù)熔絲圖大�。┫喈�(dāng)快，一般幾秒鐘就行了。

回答二：
　　1、首先可編程器件從結(jié)構(gòu)上分為cpld和fpga二類，從制造工藝上有cmos、flash、sram、反熔絲等幾種。
　　2、cpld一般來講容量較低（注意cpld和fpga的門數(shù)的定義不一樣，實際上對門沒有統(tǒng)一的定義，不能認為cpld的10000門的規(guī)模就比5000門的規(guī)模大，我們比較能接受的是在asic中定義一個與非門為一個門）。cpld的速度一般都較快，時延比較確定（注意：實際設(shè)計的時延和速度都要通過時序仿真才能確定，一般來講器件資料中所提到的最高速度在實際設(shè)計中是不可能達到的，因為所謂的最高速度是指的一級設(shè)計，并且會bypass一些路徑。）這和它的結(jié)構(gòu)有關(guān)，如：lattice有g(shù)rp概念，xilinx的9500則提出快速交換矩陣的思想，目的都是為了達到較快的速度。通過對cpld的結(jié)構(gòu)分析就會發(fā)現(xiàn)cpld的邏輯功能比ffs要多。cpld一般采用cmos和flash工藝，cmos的功耗大，但下載的速度快，flash的功耗很小，但加載的時間較長，當(dāng)然還和實際設(shè)計的一些情況有關(guān)，如：頻率、利用率等。
　　3、fpga是相對cpld而言的，它的規(guī)�？梢韵喈�(dāng)大。從結(jié)構(gòu)上講也是大同小異的，一般是由最基本的cell組成，cell內(nèi)部是lut和ffs，比較綜合考慮了的邏輯和ff的比例關(guān)系，當(dāng)然仔細看的話，每家的結(jié)構(gòu)還是有一些特點的。fpga的內(nèi)部布線資源是很豐富的，要設(shè)計好fpga必須充分了解所有的資源情況，并合理地利用。fpga的一個很大特點是時延不確定，不同的編譯有不同的結(jié)果，這一定要牢記！如果設(shè)計不好會遇到有些板子可以工作，而有的板子就是不行，盡管用的同一個fpga數(shù)據(jù)。
　　4、cpld和fpga不存在哪個好，要根據(jù)你的實際情況而選擇。
　　草草寫一下，以后最談。
問題二：
　　你好!我想請教幾個問題:
　　1、什么是ffs
　　2、在fpga時延不確定的情況下,怎樣的設(shè)計才能保證該設(shè)計是比較好的設(shè)計,而不會出現(xiàn)盡管用的同一個fpga數(shù)據(jù)有些板子可以工作，而有的板子就是不行這種情況呢?
　　謝謝!

回答一：
　　1、ffs:觸發(fā)器。
　　2、優(yōu)化設(shè)計；盡量采用同步設(shè)計；高速、多驅(qū)動通道用全局緩充驅(qū)動，合理利用長線資源等。

回答二：
　　ff 是指 flip flop，也就是觸發(fā)器的最基本單元。
　　fpga設(shè)計的時候需要特別注意最后實現(xiàn)時的最大延時，如果各條線路的最大延時能夠滿足條件，一般就不會出現(xiàn)什么太大的問題。另外，有些公司已經(jīng)推出了固定延時的fpga，只是xilinx公司還沒有。

回答三：
　　 the all effect factor, it is important that man-resource and design solution. to fpga, cplds, lattice , altera, xilinx are all very good, to marketing share, the xilinx is most high.

　　 we can design very good function , even discret logic. do you think so? lattice, altera ,xilins , it only is tools. man is no.1 for ever, so that you did not must study altera, xilinx.

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