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信號延時和時序錯誤表現(xiàn)為

發(fā)布時間:2019/2/5 16:28:32 訪問次數(shù):1359

   傳輸線會對整個電路設(shè)計帶來以下效應(yīng)。

   (1)反射信號(Renectcd⒊gllal)。MC56F8011VFAE

   (2)延時和時序錯誤(Delay&⒎而吧△ror)。

   (3)多次跨越邏輯電平門限錯誤(幾kS誡tch血g)。

   (4)過沖與下沖(01e‘hoot/Undershoot)。

   (5)串?dāng)_(hduced N0∞or⒍osstak)。

   (6)電磁輻射(EMI Radi舶c,ll)。

   信號延時和時序錯誤表現(xiàn)為:接收端信號在輸人端邏輯電平的高與低門限之間變化時,保持一段時間信號的不跳變。過多的信號延時,可能導(dǎo)致時序錯誤和器件 功能的混亂。

   通常在多個接收端并行工作時會出現(xiàn)問題。電路設(shè)計師必須確定最壞情況下的 時間延時,以確保設(shè)計的正確性。

   信號延時產(chǎn)生的原因:驅(qū)動過載,走線過長。

   多次跨越邏輯電平門限錯誤

   信號在跳變的過程中可能多次跨越邏輯電平門限從而導(dǎo)致這一類型的錯誤。多 次跨越邏輯電平門限錯誤是信號振蕩的一種特殊形式,即信號的振蕩發(fā)生在邏輯電平門限附近,多次跨越邏輯電平門限會導(dǎo)致邏輯功能紊亂。


   如果一根高速信號走線沒有被正確終結(jié)(終端匹配),那么來自于驅(qū)動端的信號脈沖在接收端將被反射,從而引發(fā)非預(yù)期效應(yīng),使信號輪廓失真。當(dāng)失真變形非常顯著時可導(dǎo)致多種錯誤,引起設(shè)計失敗。同時,失真變形的信號對騷擾的敏感性增加了,也會引起設(shè)計失敗。如果沒有考慮上訴情況,EMI將顯著增加,這就不單單會影響自身設(shè)計結(jié)果,還會造成整個系統(tǒng)的失敗。

   反射信號產(chǎn)生的主要原因:過長的走線,未被匹配終結(jié)的傳輸線,過量電容或電感及阻抗失配。


   傳輸線會對整個電路設(shè)計帶來以下效應(yīng)。

   (1)反射信號(Renectcd⒊gllal)。MC56F8011VFAE

   (2)延時和時序錯誤(Delay&⒎而吧△ror)。

   (3)多次跨越邏輯電平門限錯誤(幾kS誡tch血g)。

   (4)過沖與下沖(01e‘hoot/Undershoot)。

   (5)串?dāng)_(hduced N0∞or⒍osstak)。

   (6)電磁輻射(EMI Radi舶c,ll)。

   信號延時和時序錯誤表現(xiàn)為:接收端信號在輸人端邏輯電平的高與低門限之間變化時,保持一段時間信號的不跳變。過多的信號延時,可能導(dǎo)致時序錯誤和器件 功能的混亂。

   通常在多個接收端并行工作時會出現(xiàn)問題。電路設(shè)計師必須確定最壞情況下的 時間延時,以確保設(shè)計的正確性。

   信號延時產(chǎn)生的原因:驅(qū)動過載,走線過長。

   多次跨越邏輯電平門限錯誤

   信號在跳變的過程中可能多次跨越邏輯電平門限從而導(dǎo)致這一類型的錯誤。多 次跨越邏輯電平門限錯誤是信號振蕩的一種特殊形式,即信號的振蕩發(fā)生在邏輯電平門限附近,多次跨越邏輯電平門限會導(dǎo)致邏輯功能紊亂。


   如果一根高速信號走線沒有被正確終結(jié)(終端匹配),那么來自于驅(qū)動端的信號脈沖在接收端將被反射,從而引發(fā)非預(yù)期效應(yīng),使信號輪廓失真。當(dāng)失真變形非常顯著時可導(dǎo)致多種錯誤,引起設(shè)計失敗。同時,失真變形的信號對騷擾的敏感性增加了,也會引起設(shè)計失敗。如果沒有考慮上訴情況,EMI將顯著增加,這就不單單會影響自身設(shè)計結(jié)果,還會造成整個系統(tǒng)的失敗。

   反射信號產(chǎn)生的主要原因:過長的走線,未被匹配終結(jié)的傳輸線,過量電容或電感及阻抗失配。


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