頻譜的動態(tài)利用提高頻譜的利用率
發(fā)布時(shí)間:2020/10/31 23:44:31 訪問次數(shù):1128
頻譜資源匱乏是目前通信領(lǐng)域遇到的一個(gè)難題,緩解頻譜資源短缺的一個(gè)有效方法是頻譜感知技術(shù),它可以實(shí)現(xiàn)頻譜的動態(tài)利用,提高頻譜的利用率。
能量檢測法、匹配濾波檢測法以及循環(huán)平穩(wěn)特性檢測法3種單用戶譜感知技術(shù),然后研究了協(xié)作頻譜感知技術(shù)的系統(tǒng)結(jié)構(gòu)和感知模型,最后基于能量檢測法的協(xié)作頻譜感知中的“K-N”融合準(zhǔn)則進(jìn)行仿真,結(jié)果表明,當(dāng)K=[N+1/2]時(shí),協(xié)作頻譜感知的性能達(dá)到最優(yōu)。
標(biāo)準(zhǔn)包裝:1,000類別:電源 - 外部/內(nèi)部(外接)家庭:AC DC 臺式,壁式適配器系列:-使用地區(qū):-形式:臺式(類 II)輸入類型:軟線電壓 - 輸入:120VAC電壓 - 輸出:9V電流 - 輸出(最大值):500mA功率(W):5W空載功耗:-極化:負(fù)極中心應(yīng)用:ITE(商業(yè))效率:-工作溫度:-輸出連接器:圓管插頭,1.3mm 內(nèi)徑 x 3.5mm 外徑 x 8.5mm大小/尺寸:2.52" 長 x 1.77" 寬 x 1.55" 高(64.0mm x 45.0mm x 39.5mm)認(rèn)可:-功率(W) - 最大值:5W輸入連接器:IEC 320-C8電線長度:72"(1.83m)重量:-其它名稱:DPD090050P7N(素材來源:chinaaet和ttic.如涉版權(quán)請聯(lián)系刪除。特別感謝)
RISC-V作為一種開源精簡指令集架構(gòu),自發(fā)布以來便得到了大量關(guān)注。設(shè)計(jì)了一種三級流水線的RISC-V處理器。其中,采用靜態(tài)預(yù)測BTFN技術(shù)處理流水線執(zhí)行中的分支情況,采用前向旁路傳播技術(shù)解決數(shù)據(jù)冒險(xiǎn)問題,采用資源共享的辦法,復(fù)用寄存器堆、加法器、選擇器等模塊,使設(shè)計(jì)面積得到一定的優(yōu)化。
在VCS和Verdi等EDA工具中,使用RV32I整數(shù)運(yùn)算指令集對處理器進(jìn)行了仿真測試,結(jié)果表明,所設(shè)計(jì)的處理器功能正確,達(dá)到預(yù)定目標(biāo)。
(素材來源:chinaaet和ttic.如涉版權(quán)請聯(lián)系刪除。特別感謝)
頻譜資源匱乏是目前通信領(lǐng)域遇到的一個(gè)難題,緩解頻譜資源短缺的一個(gè)有效方法是頻譜感知技術(shù),它可以實(shí)現(xiàn)頻譜的動態(tài)利用,提高頻譜的利用率。
能量檢測法、匹配濾波檢測法以及循環(huán)平穩(wěn)特性檢測法3種單用戶譜感知技術(shù),然后研究了協(xié)作頻譜感知技術(shù)的系統(tǒng)結(jié)構(gòu)和感知模型,最后基于能量檢測法的協(xié)作頻譜感知中的“K-N”融合準(zhǔn)則進(jìn)行仿真,結(jié)果表明,當(dāng)K=[N+1/2]時(shí),協(xié)作頻譜感知的性能達(dá)到最優(yōu)。
標(biāo)準(zhǔn)包裝:1,000類別:電源 - 外部/內(nèi)部(外接)家庭:AC DC 臺式,壁式適配器系列:-使用地區(qū):-形式:臺式(類 II)輸入類型:軟線電壓 - 輸入:120VAC電壓 - 輸出:9V電流 - 輸出(最大值):500mA功率(W):5W空載功耗:-極化:負(fù)極中心應(yīng)用:ITE(商業(yè))效率:-工作溫度:-輸出連接器:圓管插頭,1.3mm 內(nèi)徑 x 3.5mm 外徑 x 8.5mm大小/尺寸:2.52" 長 x 1.77" 寬 x 1.55" 高(64.0mm x 45.0mm x 39.5mm)認(rèn)可:-功率(W) - 最大值:5W輸入連接器:IEC 320-C8電線長度:72"(1.83m)重量:-其它名稱:DPD090050P7N(素材來源:chinaaet和ttic.如涉版權(quán)請聯(lián)系刪除。特別感謝)
RISC-V作為一種開源精簡指令集架構(gòu),自發(fā)布以來便得到了大量關(guān)注。設(shè)計(jì)了一種三級流水線的RISC-V處理器。其中,采用靜態(tài)預(yù)測BTFN技術(shù)處理流水線執(zhí)行中的分支情況,采用前向旁路傳播技術(shù)解決數(shù)據(jù)冒險(xiǎn)問題,采用資源共享的辦法,復(fù)用寄存器堆、加法器、選擇器等模塊,使設(shè)計(jì)面積得到一定的優(yōu)化。
在VCS和Verdi等EDA工具中,使用RV32I整數(shù)運(yùn)算指令集對處理器進(jìn)行了仿真測試,結(jié)果表明,所設(shè)計(jì)的處理器功能正確,達(dá)到預(yù)定目標(biāo)。
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